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先进先出缓存器的verilog设计与实现
先进先出缓存器的verilog设计与实现
操作系统开发
482 K
195 次下载
2017-02-25
资源详细信息
文件格式
RAR
文件大小
482 K
资源分类
操作系统开发
上传者
shenshen00
发布时间
2017-02-25 00:38
下载统计
195
次
所需积分
2 积分
先进先出缓存器的verilog设计与实现 - 资源详细说明
先进先出缓存器的verilog设计与实现
先进先出缓存器的verilog设计与实现 - 源码文件列表
本资源包含 5 个源码文件
支持在线预览,点击文件名即可查看
1
fifo.rar
查看源码
2
基于verilog hdl语言的32x8 fifo设计和高速异步fifo的实现.rar
查看源码
3
asyn_fifo_design.rar
查看源码
4
一个可以综合的verilog 写的fifo存储器.rar
查看源码
5
设计一 双端口fifo.rar
查看源码
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