💻 基于Quartus II FPGA/CPLD数字系统设计实例（VHDL源代码文件） - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
6201
📄 and_2.sof
0 B
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6202
📄 div7.asm.rpt
6.75 KB
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6203
📄 div7.vhd
571 B
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6204
📄 div7.qpf
900 B
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6205
📄 div7.fit.smsg
513 B
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6206
📄 div7.pin
19.22 KB
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6207
📄 div7.qws
1.22 KB
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6208
📄 div7.tan.summary
978 B
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6209
📄 div7.flow.rpt
4.34 KB
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6210
📄 div7.sim.rpt
9.36 KB
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6211
📄 div7.done
26 B
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6212
📄 div7.qsf
1.81 KB
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6213
📄 div7.map.rpt
14.35 KB
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6214
📄 div7.sof
0 B
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6215
📄 div7.fit.summary
481 B
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6216
📄 div7.tan.rpt
14.08 KB
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6217
📄 div7.bsf
1.54 KB
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6218
📄 div7.map.qmsg
2.83 KB
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6219
📝 div7.cbx.xml
0 B
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6220
📄 div7.psp
0 B
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6221
📄 div7.sim.rdb
0 B
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6222
📄 div7.rtlv_sg_swap.cdb
0 B
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6223
📄 div7.sgdiff.hdb
0 B
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6224
📄 div7.cmp2.ddb
0 B
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6225
📄 div7.asm_labs.ddb
0 B
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6226
📄 div7.(0).cnf.cdb
0 B
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6227
📄 div7.eco.cdb
0 B
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6228
📄 div7.cmp.logdb
4 B
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6229
📄 div7.cmp.rdb
0 B
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6230
📄 div7.signalprobe.cdb
0 B
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6231
📄 div7.pre_map.cdb
0 B
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6232
📄 div7.tan.qmsg
19.17 KB
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6233
📄 div7.cmp.cdb
0 B
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6234
📄 div7.hier_info
131 B
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6235
📄 div7.rtlv.hdb
0 B
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6236
📄 div7.pss
0 B
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6237
📄 div7.map.cdb
0 B
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6238
📄 div7.pre_map.hdb
0 B
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6239
📄 div7.cmp.tdb
0 B
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6240
📄 div7.sld_design_entry.sci
0 B
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6241
📄 div7.sim.hdb
0 B
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6242
📄 div7.rtlv_sg.cdb
0 B
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6243
📄 div7.asm.qmsg
1.76 KB
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6244
📄 div7.sld_design_entry_dsc.sci
0 B
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6245
📄 div7.db_info
151 B
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6246
📄 div7.fit.qmsg
15.41 KB
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6247
📄 div7.map.logdb
4 B
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6248
📄 div7.syn_hier_info
0 B
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6249
📄 div7.cmp.hdb
0 B
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6250
📄 div7.fnsim.hdb
0 B
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