💻 ARM7_verilog代码 - 源码文件列表

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源码文件总数： 41 个
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序号
文件名
文件大小
操作
51
📄 testbench_regfile.v
4.15 KB
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52
📄 defines.v
4.22 KB
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53
📄 addr_reg.v
775 B
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54
📄 sign_extend.v
4.03 KB
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55
📄 and10.regout
0 B
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56
📄 test_barrel.out
6.02 KB
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57
📄 wd_reg.v
573 B
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58
📄 and10.imem
513 B
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59
📄 supercpsr.v
3.77 KB
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60
📄 testbench_regfile2.v
4.25 KB
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61
📄 arm7.imem
228 B
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62
📄 testbench_barrel.v
3.5 KB
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63
📄 alu_structural.v
14.93 KB
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64
📄 testbench_alu.v
4.7 KB
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65
📄 barrel.v
4.47 KB
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66
📄 arm7.dmemr
54 B
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67
📄 and10.dmemout
162 B
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68
📄 arm7.regout
55 B
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69
📄 arm7.dmem
57 B
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70
📄 test_booth.out
616 B
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71
📄 testbench_regfile4.v
4.48 KB
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72
📄 shift_maker.v
1.35 KB
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73
📄 alu.v
4.69 KB
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74
📄 test_addr_reg.out
650 B
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75
📄 cpuside.v
25.69 KB
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76
📄 avlmemory.v
4.63 KB
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77
📄 testbench_arm7.v
9.77 KB
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78
📄 arm7.dmemout
54 B
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79
📄 and10.regsr
0 B
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80
📄 memoryinterface.v
1.99 KB
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81
📄 clock.v
304 B
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82
📄 accessories.v
5.87 KB
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83
📄 arm7.v
3.48 KB
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84
📄 do_verilog
266 B
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85
📄 exception.mem
190 B
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86
📄 simplememory.v
3.86 KB
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87
📄 testbench_memory.v
2.91 KB
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88
📄 memoryside.v
7.17 KB
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89
📄 testbench_addr_reg.v
1.65 KB
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90
📄 testbench_regfile3.v
4.44 KB
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91
📄 testbench_dedsec.v
10.12 KB
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