💻 implemention of FPGA and DSP linking port, using Asynchronous mode - 源码文件列表

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源码文件总数： 50 个
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序号
文件名
文件大小
操作
1
📄 fpga_dsp_portlink.fit.eqn
64 KB
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2
📄 fpga_dsp_portlink.tan.rpt
64 KB
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3
📄 freq_divider_4.bsf
1.56 KB
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4
📄 fifo_wrn_bydsp.inc
923 B
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5
📄 cout.bsf
1.89 KB
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6
📄 fpga_dsp_portlink.asm.rpt
7.45 KB
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7
📄 fpga_dsp_portlink.qsf
4.12 KB
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8
🌐 pll0_waveforms.html
770 B
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9
📄 fifo_wrn_bydsp_inst.vhd
241 B
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10
📄 mux.bsf
2.48 KB
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11
📄 fifo_wrn_bydsp.vhd
7 KB
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12
📄 fifo_test.bdf
9.25 KB
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13
📄 fpga_dsp_portlink.vwf
45.01 KB
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14
📄 fifo_wrn_bydsp.cmp
1.08 KB
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15
📄 cout.inc
850 B
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16
📄 fifo_test.vwf
21.65 KB
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17
📄 fpga_dsp_portlink.flow.rpt
3.95 KB
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18
📄 fpga_dsp_portlink.fit.rpt
64 KB
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19
📄 fpga_dsp_portlink.fit.summary
533 B
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20
📄 fpga_dsp_portlink_bibus_onefifo.bdf
16.4 KB
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21
📄 lpm_bustri0.bsf
2.91 KB
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22
📄 fpga_dsp_portlink.cdf
307 B
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23
📄 fifo_rdn_bydsp.inc
923 B
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24
📄 lpm_bustri0_inst.vhd
183 B
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25
📄 cout.vhd
4.07 KB
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26
📄 fpga_dsp_portlink.done
26 B
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27
📄 fifo_wrn_bydsp_wave0.jpg
0 B
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28
📄 fpga_dsp_portlink.qws
1.69 KB
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29
📄 fifo_rdn_bydsp.bsf
3.37 KB
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30
📄 pll0.inc
855 B
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31
📄 pll0.vhd
9.01 KB
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32
📄 pll0_wave0.jpg
0 B
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33
📄 fifo_rdn_bydsp.cmp
1.08 KB
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34
📄 fpga_dsp_portlink.pof
0 B
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35
📄 fifo_rdn_bydsp.vhd
7 KB
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36
📄 lpm_bustri0.vhd
3.75 KB
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37
📄 lpm_bustri0.cmp
1.03 KB
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38
📄 fpga_dsp_portlink_assignment_defaults.qdf
27.33 KB
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39
📄 fifo_wrn_bydsp.bsf
3.37 KB
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40
📄 fpga_dsp_portlink_inner.bdf
20.11 KB
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41
📄 fpga_dsp_portlink_bibus.bsf
3.54 KB
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42
📄 fpga_dsp_portlink_bibus.bdf
22.49 KB
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43
📄 biport_test.bdf
6.31 KB
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44
📄 lpm_bustri1_inst.vhd
183 B
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45
📄 pll0.cmp
934 B
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46
📄 pll0_inst.vhd
103 B
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47
📄 mux.vhd
581 B
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48
📄 freq_divider_4.vhd
791 B
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49
📄 fpga_dsp_portlink.map.eqn
64 KB
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50
📄 fifo_rdn_bydsp_inst.vhd
241 B
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