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智能全数字锁相环的设计用VHDL语言在CPLD上实现串行通信
智能全数字锁相环的设计用VHDL语言在CPLD上实现串行通信
电子书籍
776 K
200 次下载
2014-01-08
资源详细信息
文件格式
RAR
文件大小
776 K
资源分类
电子书籍
上传者
lanyiting1
发布时间
2014-01-08 01:24
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200
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智能全数字锁相环的设计用VHDL语言在CPLD上实现串行通信 - 资源详细说明
智能全数字锁相环的设计用VHDL语言在CPLD上实现串行通信
智能全数字锁相环的设计用VHDL语言在CPLD上实现串行通信 - 源码文件列表
本资源包含 12 个源码文件
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1
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异步fifo结构及fpga设计.doc
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使用pld内部锁相环解决系统设计难题.doc
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7
基于fpga的高频时钟的分频和分配设计.doc
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~$fifo结构及fpga设计.doc
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9
基于cpld fpga的半整数分频器的设计.doc
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10
用cpld控制曼彻斯特编解码器.doc
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11
基于fpga的全数字锁相环设计.pdf
查看源码
12
智能全数字锁相环的设计.doc
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