💻 verilog代码读写SDRAM 不带仿真 - 源码文件列表

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源码文件总数： 27 个
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序号
文件名
文件大小
操作
751
📄 .project
2.83 KB
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752
📄 .cdtbuild
1.77 KB
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753
📄 org.eclipse.cdt.managedbuilder.core.prefs
300 B
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754
📄 org.eclipse.cdt.core.prefs
106 B
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755
📃 readme.txt
0 B
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756
📄 .cdtproject
2.41 KB
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757
📄 system.stf
1.15 KB
查看源码
758
📄 .project
2.83 KB
查看源码
759
📄 .cdtbuild
1.77 KB
查看源码
760
📄 org.eclipse.cdt.managedbuilder.core.prefs
294 B
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761
📄 org.eclipse.cdt.core.prefs
106 B
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762
📄 vga_system.bdf
30.72 KB
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763
📄 altpll0.bsf
3.84 KB
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764
📃 sopc_builder_log.txt
3.01 KB
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765
📄 sys_clk_timer.v
6.74 KB
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766
📄 vga_sys.bsf
7.89 KB
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767
📄 vga_system.asm.rpt
7.69 KB
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768
📄 cb_generator.pl
30.5 KB
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769
📄 class.ptf
7.28 KB
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770
📄 vga_system.pin
56.96 KB
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771
📄 cpu_mult_cell.v
5.96 KB
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772
📄 vga_system.fit.summary
629 B
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773
📄 vga_system.qsf
14.4 KB
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774
📄 vga_system.jdi
29.3 KB
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775
📄 vga_system.tan.rpt
64 KB
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776
📄 cpu_jtag_debug_module_wrapper.v
9.62 KB
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777
📃 使用说明请参看右侧注释====〉〉.txt
0 B
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