💻 实现USB接口功能的VHDL和verilog完整源代码 - 源码文件列表

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源码文件总数： 44 个
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序号
文件名
文件大小
操作
101
📄 usb_new_usb_int_ent.vhdl
7.03 KB
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102
📄 usb_new_rgen_rtl.vhdl
7.56 KB
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103
📄 usb_new_tx_sf_dpdm_ent.vhdl
1.02 KB
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104
📄 usb_new_upstreamled_ent.vhdl
1.46 KB
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105
📄 usb_new_ep_handler_rtl.vhdl
10.57 KB
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106
📄 usb_new_uc_handler_rtl.vhdl
40.37 KB
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107
📄 usb_new_pck_setup.vhdl
12.31 KB
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108
📄 usb_new_clkrec_ent.vhdl
1.78 KB
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109
📄 usb_new_vsc9_ram_c0.vhd
11.27 KB
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110
📄 usb_new_vsc9_ram_c1.vhd
11.28 KB
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111
📄 usb_new_uc_handler_ent.vhdl
2.93 KB
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112
📄 usb_new_pvci_cntrl_ent.vhdl
3.25 KB
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113
📄 usb_new_vpb_wrapper_rtl.vhdl
3.48 KB
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114
📄 usb_new_device_handler_rtl.vhdl
15.3 KB
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115
📄 usb_new_vsc9_ram.vhd
25.54 KB
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116
📄 usb_new_vsc9_ram_lfsr_c1.vhd
42.29 KB
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117
📄 usb_new_usbvpb_top_ent.vhdl
4.8 KB
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118
📄 usb_new_usbpvci_ent.vhdl
4.83 KB
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119
📄 usb_new_vsc9_ram_cm1.vhd
9.67 KB
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120
📄 usb_new_sie_rtl.vhdl
31.5 KB
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121
📄 usb_new_synchronizer_ent.vhdl
6.13 KB
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122
📄 usb_new_pvci_eng_ent.vhdl
5.84 KB
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123
📄 usb_new_sieinterface_rtl.vhdl
21.77 KB
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124
📄 usb_new_vsc9_ram_lfsr_c0.vhd
42.29 KB
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125
📄 usb_new_rcv_ram_rtl.vhdl
17.78 KB
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126
📄 usb_new_sieinterface_ent.vhdl
3.43 KB
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127
📄 usb_new_clkrec_rtl.vhdl
8.27 KB
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128
📄 usb_new_usbpvci_dft_ent.vhdl
4.56 KB
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129
📄 usb_new_vpb_wrapper_ent.vhdl
2.56 KB
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130
📄 usb_new_pck_configuration.vhdl
31.26 KB
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131
📄 usb_new_pck_apb.vhdl
9.07 KB
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132
📄 usb_new_ep_handler_ent.vhdl
5.61 KB
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133
📄 usb_new_glue_rtl.vhdl
4.18 KB
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134
📄 usb_new_synchronizer_rtl.vhdl
14.03 KB
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135
📄 usb_new_vsc9_ram_xor_pkg.vhd
2.6 KB
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136
📄 usb_new_vsc9_ram_cm0.vhd
9.66 KB
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137
📄 usb_new_rcv_ram_ent.vhdl
3.63 KB
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138
📄 usb_new_vsc9_ram_addressor.vhd
16.98 KB
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139
📄 usb_new_upstreamled_rtl.vhdl
2.55 KB
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140
📄 usb_new_timers_sf_ent.vhdl
2.54 KB
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141
📄 usb_new_timers_sf_rtl.vhdl
10.99 KB
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142
📄 usb_new_usb_cntrl_rtl.vhdl
15.22 KB
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143
📄 usb_new_usb_int_str.vhdl
41.29 KB
查看源码
144
📄 usb_new_sie_ent.vhdl
3.62 KB
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