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51单片机C语言常用模块与综合系统设计实例精讲 - 源码文件列表
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图5-4 lcd模块的初始化流程.jpg
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图5-5 基于msc-g12232的液晶显示电路原理图.jpg
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图9-5 i2c串行接口数据传输时序.jpg
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图9-7 实时时钟实时数据寄存器.jpg
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图9-11 可选频率输出示例.jpg
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图9-8 状态寄存器.jpg
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图9-10 实时时钟int1和int2寄存器频率数据.jpg
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图9-2 sd2000a内部电路框图.jpg
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图9-6 i2c串行接口的确认信号时序.jpg
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图9-3 基于sd2000的实时日历时钟系统电路原理图.jpg
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图9-9 实时时钟int1和int2寄存器为报警时间数据.jpg
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图9-4 i2c串行接口时序的开始和停止条件.jpg
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图9-1 sd2000、sd2001、sd2002系列产品管脚分配图.jpg
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图8-4 at24c64芯片地址.jpg
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图8-8 at24c64 随机读时序.jpg
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图8-5 at24c64 写字节时序.jpg
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图8-1 at24c64封装.jpg
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图8-10 单片机部分原理图.jpg
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图8-6 at24c64 写一页时序.jpg
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图8-11 at24c64 部分原理图.jpg
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图8-7 at24c64 读当前地址时序.jpg
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图8-2 i2c开始和结束时序.jpg
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图8-3 i2c应答时序.jpg
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图8-9 at24c64 顺序读时序.jpg
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图5-7 80脚qfp封装msm6255的管脚分布图.jpg
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图5-8 基于msm6255 驱动器的显示电路的单片机部分电路原理图.jpg
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图5-6 lcd控制器msm6255的内部功能框图.jpg
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图5-21 4比特并行模式,hp=8时点时钟与字符时钟的关系.jpg
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图5-19 4比特并行模式数据传输时序.jpg
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图5-9 基于msm6255 驱动器的显示电路的地址锁存与数据控制部分电路原理图.jpg
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图5-16 在图形模式下的显存地址(640x200).jpg
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图5-18 2比特并行模式数据传输时序.jpg
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图5-13 平板af1 el屏接口电路原理图.jpg
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图5-11 显存连接电路原理图.jpg
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图5-12 读写控制逻辑电路原理图.jpg
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图5-10 msm6255连接电路原理图.jpg
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图5-14 模式控制寄存器mor的定义.jpg
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图5-15 光标显示设置.jpg
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图5-17 1比特串行模式数据传输时序.jpg
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图5-20 同步访问显存的基本时序.jpg
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11-1 crc-16比特型算法实现的硬件电路图.jpg
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图4-4 7段数码管内部字段led和引脚分布.jpg
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图4-5 7段数码管两种结构形式a.jpg
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图4-12 7段数码管动态显示电路原理图之cpu和锁存电路.jpg
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图4-11 7段数码管动态显示电路原理图之数码管驱动电路.jpg
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图4-6 7段数码管两种结构形式b.jpg
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图4-7 74ls47管脚定义.jpg
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图4-10 7段数码管静态显示电路原理图之锁存译码电路.jpg
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图4-9 7段数码管静态显示电路原理图之cpu电路.jpg
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图4-8 7段数码管静态显示电路原理图之锁存电路.jpg
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