cnt
共 24 篇文章
cnt 相关的电子技术资料，包括技术文档、应用笔记、电路设计、代码示例等，共 24 篇文章，持续更新中。
51单片机子程序.CNT
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CNT-AVER1.pdf
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密码锁
智能密码锁的系统结构框图由图1所示,它分成两大部分:控制器和处理器。整个系统的输入信号只有一个时钟脉冲CP ,输出信号有锁开信号OPEN 和报警信号ALERT。控制器中的所有按键按下时均为低电平,即低电平有效。RESET 为“密码设定”信号,CLR 为“清零”信号,OK 为“确定”信号, TRY 为“开锁”信号,CNT 表示上一位密码正确时,控制器给出的可进行下一位二进制密码比较的信号,OPEN
基于Proteus的数电课程设计乒乓球游戏机
<p>第一章设计任务书</p><p>一、设计题目：乒乓球比赛游戏机</p><p>二、设计要求：</p><p>1.设计一个甲、乙双方参赛，裁判参与的乒乓球比赛游戏模拟机。</p><p>2.用8个发光二极管排成一条直线，以中点为界，两边各代表参赛双方的位置，其中点亮的发光二极管代表“乒乓球”的当前位置，点亮的发光二极管依次由左向右或由右向左移动。</p><p>3.当球运动到某方的最后一位时，参赛者应立
verilog实现I2C通信的slave模块源码状态机设位计可做I2C接口的仿真模型
<p>verilog实现I2C通信的slave模块源码状态机设位计可做I2C接口的仿真模型</p><p><br/></p><p>//`timescale 1ns/1ps</p><p>module I2C_slv (</p><p>input [6:0] slv_id,</p><p>input RESET,</p><p>input &nb
spi 通信的master部分使用的verilog语言实现
<p>spi 通信的master部分使用的verilog语言实现，可以做为你的设计参考。</p><p>module spi_master(rstb,clk,mlb,start,tdat,cdiv,din, ss,sck,dout,done,rdata);</p><p> input rstb,clk,mlb,start;</p><p> input
ADS8329 Verilog fpga 驱动源码 2.7V 至 5.5V 16 位 1MSPS 串
<p>ADS8329 Verilog fpga 驱动源码，2.7V 至 5.5V 16 位 1MSPS 串行模数转换器 ADC芯片ADS8329数据采集的verilog代码，已经用在工程中，可以做为你的设计参考。</p><p><br/></p><p>(</p><p> input clock, </p><p> input timer_clk_r,</p><p> input reset,&n
IIC接口E2PROM(AT24C64) 读写VERILOG 驱动源码+仿真激励文件: module
<p>IIC接口E2PROM(AT24C64) 读写VERILOG 驱动源码+仿真激励文件:</p><p>module i2c_dri</p><p> #(</p><p> parameter SLAVE_ADDR = 7'b1010000 , //EEPROM从机地址
java通用分页 PageUtils pu = new PageUtils(10,cnt,"cxdy.do",page_num) //从前之后依次是：数据总量
java通用分页
PageUtils pu = new PageUtils(10,cnt,"cxdy.do",page_num) //从前之后依次是：数据总量，跳转路径，当前跳转至页数
String page = pu.page()
本程序将指定的显示缓冲区送显
本程序将指定的显示缓冲区送显，并将读取的键值送显。
入口参数：显示缓冲区首地址在SADR中,要显示的位数在CNT中。
出口参数: 无。
四位十进制频率计设计 包含测频控制器（TESTCTL）
四位十进制频率计设计
包含测频控制器（TESTCTL），4位锁存器(REG4B)，十进制计数器（CNT10）的原程序(vhd)，波形文件(wmf ),包装后的元件(bsf)。顶层原理图文件（Block1.bdf）和波形。
红外遥控RGB
<pre class="prettyprint lang-cpp">#include "STC90.h"
#include < intrins.h >
#define uchar unsigned char
#define uint unsigned int
#define led_port P1
sbit IR_RE = P3^2;
sbit led_r = P1^3;
sbit
如果四位数各位上的数字均是0或2或4或6或8, 则统计出满足此条件的个数cnt, 并把这些四位数按从大到小的顺序存入数组b中
如果四位数各位上的数字均是0或2或4或6或8, 则统计出满足此条件的个数cnt, 并把这些四位数按从大到小的顺序存入数组b中
六位计时器cnt6
这是一个vhd源码，他是一个文本，是一个六位计数器
void __irq Uart0_TxInt(void) void __irq Uart0_RxIntOrErr(void) void __irq Uart0_TxDmaDone(void)
void __irq Uart0_TxInt(void)
void __irq Uart0_RxIntOrErr(void)
void __irq Uart0_TxDmaDone(void)
void __irq Uart0_R xDmaOrErr(void)
void __irq Uart0_TxFifo(void)
void __irq Uart0_RxFifoOrErr(
电脑横机上程序转换,(*.CNT*.PAT)
电脑横机上程序转换,(*.CNT*.PAT)
基于CPLD的棋类比赛计时时钟,第一个CNT60实现秒钟计时功能
基于CPLD的棋类比赛计时时钟,第一个CNT60实现秒钟计时功能，第二个CNT60实现分钟的计时功能，CTT3完成两小时的计时功能。秒钟计时模块的进位端和开关K1相与提供分钟的计时模块使能，当秒种计时模块计时到59时向分种计时模块进位，同时自己清零。同理分种计时模块到59时向CTT3小时计时模块进位，到1小时59分59秒时，全部清零。同时，开关K1可以在两小时内暂停秒钟计时模块，分钟计时模块和小时
采用LRU替换算法。这种算法选择最久没有被访问的块作为被替换的块。 为了实现LRU算法
采用LRU替换算法。这种算法选择最久没有被访问的块作为被替换的块。
为了实现LRU算法，要在块表中为每一块设置一个计数器（cnt0，cnt1，cnt2，cnt3，）。计数器的长度为2位。
可预置的8位计数器程序的主要部分分析 #include <AT89X51.H> //器件配置文件 #define uchar unsigned char //变量类型的宏定义
可预置的8位计数器程序的主要部分分析
#include <AT89X51.H> //器件配置文件
#define uchar unsigned char //变量类型的宏定义
#define uint unsigned int
uchar code SEG7[10]={0x03,0x9f,0x25,0x0d,0x99, //0~9的数码管段码
0x49,0x41,
PWM的实现过程中使用了两个计数器CNT 1和CNT2
PWM的实现过程中使用了两个计数器CNT 1和CNT2，通过技术比较来判定LED灯泡是否点亮:若CNT1<CNT2 ，LED灯泡由熄灭状态进入点亮状态 若CNT1>CNT2则LED灯泡由点亮状态进入熄灭状态。各基色LED灯泡是串行连接的，并且只需改变一种基色LED灯泡的状态便能实现色彩的变换，因此，系统计数器CNT1和CNT2只设立一组。如果当前改变的是红色LED灯泡的亮度，那么绿色和