DRAM
共 70 篇文章
DRAM 相关的电子技术资料，包括技术文档、应用笔记、电路设计、代码示例等，共 70 篇文章，持续更新中。
use dsp5402 dram to let green led flashing in order to test dsp
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vhdl SOPC solution sram dram uart 3
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vhdl SOPC solution sram dram uart -2
vhdl SOPC solution sram dram uart -2
通过环路串口判断串行通信电平转换芯片功能是否正常
通过环路串口判断串行通信电平转换芯片功能是否正常，并通过读写DRAM 判断硬件。
本程式為使用Verilog語言寫控制DRAM的控制模塊, 可以簡易的控制DRAM IC, 本程式已經過系統驗證.
本程式為使用Verilog語言寫控制DRAM的控制模塊, 可以簡易的控制DRAM IC, 本程式已經過系統驗證.
DRAM内存模块的设计技术
<P>第二部分：DRAM 内存模块的设计技术..............................................................143<BR>第一章 SDR 和DDR 内存的比较..........................................................................143<BR>第二章 内存模块的叠
2410 nand boot load!（4K DRAM) 0地址开始运行
2410 nand boot load!（4K DRAM)
0地址开始运行，没有象VIVI拷贝自身到
高端内存运行，可以用它加载UBOOT。
也可以改写它用来引导自己的系统
vhdl SOPC solution sram dram uart 4
vhdl SOPC solution sram dram uart 4
存储器技术.doc
<P>存储器技术.doc</P>
<P style="TEXT-ALIGN: center" align=center><FONT size=3><FONT face=宋体>计算机的主存储器（Main Memory），又称为内部存储器，简称为内存。内存实质上是一组或多组具备数据输入输出和数据存储功能的集成电路。内存的主要作用是用来存放计算机系统执行时所需要的数据，存放各种输入、输出数据和中间计算结
vhdl SOPC solution sram dram uart
vhdl SOPC solution sram dram uart
用汇编写的2440复制nand到DRAM的代码
用汇编写的2440复制nand到DRAM的代码
dram.rar-R3 DARM的基本工作原理
dram.rar-R3 DARM的基本工作原理，比较详细
用vhdl描写的通用异步改进dram控制器
用vhdl描写的通用异步改进dram控制器，经过编译器综合和仿真测试，符合设计要求。
把flash的代码搬移到Dram的0xc
把flash的代码搬移到Dram的0xc
在合众达DM642平台上实现mpeg2编解码算法 工程内有gel文件配置相应的dram参数
在合众达DM642平台上实现mpeg2编解码算法
工程内有gel文件配置相应的dram参数
管脚号 管脚名称 LEVER 管脚功能描述 1 VSS 0V 电源地 2 VDD 5.0V 电源电压 3 VEE 5.0V~(-13V) 液晶显示器驱动电压 4 D/I H/L D/I
管脚号 管脚名称 LEVER 管脚功能描述
1 VSS 0V 电源地
2 VDD 5.0V 电源电压
3 VEE 5.0V~(-13V) 液晶显示器驱动电压
4 D/I H/L D/I=“H”,表示DB7~DB0为显示数据
D/I=“L”,表示DB7~DB0为显示指令数据
5 R/W H/L R/W=“H”,E=“H”,数据被读到DB7~DB0
R/W=“L”,E=“H
免费的AHDL模块库,包括IIC控制器,DRAM控制器,UART等28个模块,AHDL源代码
免费的AHDL模块库,包括IIC控制器,DRAM控制器,UART等28个模块,AHDL源代码
介绍了关于怎样用DRAM 芯片用做 摄象机
介绍了关于怎样用DRAM 芯片用做 摄象机，即相关的程序及硬件结构，本DIY制作需要的相关知识为：计算机并行口接口信号、Inter 80X86 宏汇编语言、TURBO C 语言、DRAM 芯片原理 英文
uCLinux默认的根文件系统是romfs
uCLinux默认的根文件系统是romfs，由于romfs是一个只读的文件系统，当你的嵌入式设备动态的修改了一些文件，它无法保存。JFFS而可以动态的把DRAM中的数据烧入Flash中，此文件是实现他的一个MTD文件
The main MIPS processor of SMP8630 comes with a JTAG interface, allowing: access to caches and da
The main MIPS processor of SMP8630 comes with a JTAG interface, allowing:
access to caches and data bus (DRAM) with a bandwidth of about 200kbit/s
examining the processor state whatever the exec