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高速串并转换器的设计是FPGA 设计的一个重要方面,传统设计方法由于采用FPGA 的内部逻辑资源来实现,从而限制了串并转换的速度。该研究以网络交换调度系统的FGPA 验证平台中多路高速串并转换器的设计...

📅 2013-11-03

高速串并转换器的设计是FPGA 设计的一个重要方面,传统设计方法由于采用FPGA 的内部逻辑资源来实现,从而限制了串并转换的速度。该研究以网络交换调度系统的FGPA 验证平台中多路高速串并转换器的设计...

📅 2013-11-17

用汇编写的串并转换程序，在masm 下调试...

📅 2015-05-01

用VHDL编写的并串转换和串并转换实例，希望对您有所帮助，其中输入数据是时钟的16倍...

📅 2015-06-08

通过多通道串-并转换器将多个同步串行数据流转换为并行数据...

📅 2013-12-25

一个可综合的串并转换接口verilog源代码...

📅 2014-01-07

Verilog HDL编写的串并转换。采用iout类型口。包含源文件和测试文件。用Modsim编译。...

📅 2014-01-15

本文分别以GPI0口直接连接、串并转换连接、CPLD分部连接三种方法阐述了无外部总线的Philips ARM微控制器LPC2l0X与点阵图形液晶显示器的接口设计,并给出了硬件电路框图和主要程序。...

📅 2014-01-22

串并转换源代码．串并转换源代码．...

📅 2014-01-14

QPSK详细的调制解调程序。包括串并转换，判决等等。...

📅 2015-11-27

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