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★ 内置Display data RAM
2021-12-07 09:39:48
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幸运的是，即使你不会51单片机，Ration也可以带领你彻底征服这个看似复杂实则简单的单片机
不管是什么单片机，本质上都一样，对外表现为N个引脚，用引脚的高低电平变化来完成各种控制通信工作。
2022-04-02 20:30:01
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两年前，编辑《时序篇》之际，笔者忽然对TimeQuest 产生兴趣，可是笔者当时却就连
时序是什么也不懂，更不明白时序有理想和物理之分，为此笔者先着手理想时序的研究。
2022-05-02 22:00:01
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从调试到现在已经烧毁了5片stm32都是cpu短路，等有空查查是什么原因。
2022-06-10 17:30:01
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节点模型的实现上，利用FPGA内嵌的RocketIO高速串行收发器实现主机之间的高速串行通信，并利用Aurora IP核实现了Aurora链路层协议；设计一个同步FIFO实现旁路FIFO；利用FPGA上的块RAM
2013-04-24 16:38:22
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同时以该FPGA生成双口RAM，实现数据暂存，以匹配采样速率和脉压系统频率。 (3)设计基于4片高性能ADSP21160M的紧耦合并行处理系统，以完成多波形频域数字脉冲压缩的全部运算工作。
2013-06-11 09:20:01
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选用PHILIPS的32位ARM芯片LPC2214作为分站的控制芯片，它带有16KB的静态RAM和256KB的高速FLASH，包含8路10位A/D，还有多个串行接口，可使用的GPIO高达76个(使用了外部存储器
2013-04-24 16:38:32
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提出了有效的抗干扰措施.最后,利用运动控制卡强大的运动控制功能,并针对激光雕刻行业进行大幅图形扫描时需要实时处理大量的图形数据的特别需要,在板卡第四轴完全实现了激光控制功能,并基于FPGA内部的16KBit块RAM
2013-06-09 19:30:01
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该课题在设计过程中还提出了两个有效的设计思路：第一是在32位寄存器的设计中利用FPGA的内部RAM资源来设计，减少了传输延时，提高了运行速度，并大大减少了对FPGA内部资源的占用；第二是在系统架构上采用了柔性化的设计方法
2013-07-21 13:20:01
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随着数字电路、大规模集成电路及微处理器技术的发展，尤其是高速模/数（A/D）转换器及半导体存储器（RAM）的发展，数字存储示波器的采样速率和实时性能得到了很大的提高，在工程测量中，越来越多的工程师用DSO
2013-07-07 16:30:01
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由图1可见，以内含C52兼容单片机的ADuC845为控制核心．配有640 KB的非易失RAM数据存储器、外扩键盘输人、320x240点阵的图形液晶显示器进行汉字、图形、曲线和数据显示，超温报警装置等外围电路
2013-10-11 13:24:01
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运行PROTEUS软件，计算机系统需具有：200MHz或更高的奔腾处理器，Win98/Me/2000/XP或更高版本的操作系统，64MB或以上的可用硬盘空间，64MB或以上的RAM空间，用PROTEUS
2013-11-05 21:28:01
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运行 Keil 软件需要 Pentium 或
以上的 CPU， 16MB 或更多 RAM、 20M 以上空闲的硬盘空间、 WIN98、 NT、 WIN2000、 WINXP
2019-05-30 11:49:37
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STC12C5A60S2单片机是深圳宏晶科技有限公司的典型单片机产品，采用了增强型8051内核，片内集成了60KB程序Flash、1KB数据Flash（EEPROM）、
1280字节RAM
2022-06-25 12:50:01
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但在芯片的内部却集成了中央处理器单元(CPU)，各种存储器(RAM、ROM、EPROM、E2PROM和FlashROM 等)，各种输入/输出接口(定时器/计数器、并行I/O、串行I/O以及A/D转换接口等
2023-01-13 15:40:02
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21章 单片机实现步进式PWM信号输出
第22章 单片机实现CRC算法
第五篇 通信传输系统
第23章 单片机实现点对点的数据传输
第24章 单片机实现点对多点的数据传输
第25章 基于双口RAM
2023-03-16 10:30:03
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该课题在设计过程中还提出了两个有效的设计思路：第一是在32位寄存器的设计中利用FPGA的内部RAM资源来设计，减少了传输延时，提高了运行速度，并大大减少了对FPGA内部资源的占用；第二是在系统架构上采用了柔性化的设计方法
2023-06-13 16:40:05
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在设计中，本文采用了双口RAM作为数据接口的存放缓冲区。使用这种结构的优势在于，可以使得数据处理的可靠性更高、运算速度更快，系统的内核结构更加简单明了。
2023-09-29 05:00:02
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节点模型的实现上，利用FPGA内嵌的RocketIO高速串行收发器实现主机之间的高速串行通信，并利用Aurora IP核实现了Aurora链路层协议；设计一个同步FIFO实现旁路FIFO；利用FPGA上的块RAM
2023-09-30 14:00:01
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同时以该FPGA生成双口RAM，实现数据暂存，以匹配采样速率和脉压系统频率。 (3)设计基于4片高性能ADSP21160M的紧耦合并行处理系统，以完成多波形频域数字脉冲压缩的全部运算工作。
2023-11-01 09:00:01
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