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看门狗的verilog源代码，项目的一部分，绝对正确，测试通过。
2014-01-04 23:32:01
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verilog语言的北大教材。PPT格式，比较详细
2013-12-28 21:29:01
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verilog语言的北大教材。PPT格式，比较详细
2014-11-30 09:07:02
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verilog语言的北大教材。PPT格式，比较详细
2014-01-05 20:17:02
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verilog语言的北大教材。PPT格式，比较详细
2014-12-05 21:02:01
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verilog语言的北大教材。PPT格式，比较详细
2017-04-02 10:04:02
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自己实用Verilog编写的UART程序，1位开始位，8位数据位，1位停止位，本测试程序配置完管脚后，实用串口大师发送数据，则返回数据为发送数据+1
2014-01-26 21:04:11
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是关于verilog 的电子书，对于学习verilog 语言有很大的帮助，是一本很好的入门教材。
2014-01-16 06:22:01
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这是一段pll verilog代码，是本人转载！
2014-01-15 05:35:01
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6 bit dadda tree reduction code -- verilog
2013-11-29 15:16:08
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用verilog编写的抢答器，当主持人宣布“开始比赛”，系统初始化，选手进入“抢答状态”。当某一选手首先按下抢答开关时，相应的指示灯亮，此时抢答器不再接受其他输入信号。
2014-01-16 08:47:01
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verilog的简要教程
基本逻辑门，例如a n d、o r和n a n d等都内置在语言中。
• 用户定义原语（ U D P）创建的灵活性。
2017-05-05 00:26:02
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Verilog block SPI for Burst R/W Operation
2017-05-06 10:08:01
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Verilog notes - Part 1 from IIT M
2014-01-06 19:14:11
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Verilog notes - Part 2 from IIT M
2014-09-08 08:30:02
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Verilog notes - Part 3 from IIT M
2013-12-22 09:07:06
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Verilog notes - Part 4 from IIT M
2017-05-06 10:26:02
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Verilog notes - Part 33 from IIT M
2013-12-23 02:17:09
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用verilog HDL写的VGA驱动，在FPGA上实测可用（实际上是别人的劳动成果，呵呵）。
2014-01-15 05:56:01
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Verilog 下 16位除法算法程序，高精度，固定17个时钟周期
2013-11-26 15:57:13
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