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介绍了一种用FPGA 器件实现电话计费系统的方法, 并给出了设计框图和详细设计过程, 设计采用Verilog_HDL 硬件语言。
2013-08-18 23:00:01
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Testbenches have become an integral part of the design process, enabling you to verify that
your HDL
2016-03-24 10:27:02
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Synplicity公司最新推出的一种验证工具，可以在FPGA工作时查看实际的节点信号，甚至可以像调试单片机一样，在HDL代码中设断点indentify是集成在synplify软件中的，你安装synplify
2024-05-07 01:30:01
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Synplicity公司最新推出的一种验证工具，可以在FPGA工作时查看实际的节点信号，甚至可以像调试单片机一样，在HDL代码中设断点indentify是集成在synplify软件中的，你安装synplify
2014-03-30 12:22:13
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在软件开发领域一个非常流行的人月神话问题：在众多的软件开发项目中，缺乏合理的时间进度是造成项目滞后的最主要原因，它比其他所有因素加起来影响还大，导致这种普遍性灾难的原因是什么呢？
2013-12-11 13:14:02
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对 CAN 是什么、 CAN 的特征、标准规格下的位置分布等、CAN 的概要及 CAN 的协议进行了说明。
2019-01-09 10:32:45
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workshop in implementing DSP functions focuses on learning how to use System Generator for DSP, as well as HDL
2014-12-06 00:36:06
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本文简述空间对接的基本概念，对空间对接装置中的通用算法，包括预处理、自动门
限和隔点差分的FPGA 实现进行了详尽的分析，对VHDL 与Verilog HDL 两种硬件描述语
言的区别加以
2024-05-18 18:20:01
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随着HDL Hardware Description Language 硬件描述语言语言综合工具及其它相关工具的推广使广大设计工程师从以往烦琐的画原理图连线等工作解脱开来能够将工作重心转移到功能实现上极大地提高了工作效率任何事务都是一分为二的有利就有弊我们发现现在越来越多的工程师不关心自己的电路实现形式以为我只要将功能描述正确其它事情交给工具就行了在这种思想影响下工程师在用
2013-11-06 00:48:01
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随着HDL Hardware Description Language 硬件描述语言语言综合工具及其它相关工具的推广使广大设计工程师从以往烦琐的画原理图连线等工作解脱开来能够将工作重心转移到功能实现上极大地提高了工作效率任何事务都是一分为二的有利就有弊我们发现现在越来越多的工程师不关心自己的电路实现形式以为我只要将功能描述正确其它事情交给工具就行了在这种思想影响下工程师在用
2015-01-02 00:45:01
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锅炉的作用是什么？答：锅炉是一种生产蒸汽或热水的热力设备，一般由“锅”与“炉”两部分组成。
2013-11-13 15:36:01
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你知道第一台平板电脑是什么样子吗？你知道平板电脑的历史比笔记本电脑还长吗？平板电脑以便携著称，但你知道早期的平板电脑比笔记本电脑还重吗？
2022-11-24 08:50:02
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这些信息可以输出到图上，画出坐标点，也可以用KML（这是什么？）输出到Google Earch里去。
2023-04-07 20:20:03
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本文介绍了I2C总线规范，并根据该规范对I2C进行模块化设计，用Verilog HDL 语言对每个模块进行具体描述，并通过模块之间的调用，基本实现了I2C的主机从机的发送和
接收功能。
关
2013-04-24 16:38:34
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本文介绍了I2C总线规范，并根据该规范对I2C进行模块化设计，用Verilog HDL 语言对每个模块进行具体描述，并通过模块之间的调用，基本实现了I2C的主机从机的发送和
接收功能。
关
2023-06-14 16:30:05
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2005年全国单片机与嵌入式系统学术交流会论文，本文用三层结构的逻辑描述方式描述了红外数据通道的构架和设计，并给出了上述核心部分状态机的HDL（硬件描述语言）描述及其仿真结果。
2024-09-28 16:50:02
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文本程序输入（Verilog HDL）
2. 功能仿真（ModelSim，查看逻辑功能是否正确，要写一个Test Bench）
2025-05-15 06:30:01
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浅析VC与MATLAB联合编程<一>、<二>,<三>部分中，简单介绍了VC和MATLAB接口的两种方法，初学者可能会问为什么要用VC和MATLAB接口，接口的实质又是什么
2013-12-23 12:50:13
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2022-09-09 19:00:02
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Generally, when designing a state machine using an HDL, the synthesis tools will optimize away all states
2013-10-08 21:28:02
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