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This is UART Receiver interface C code Tested on Sparton 3 xilinx FPGA.
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This is UART Transmitter interface C code Tested on Sparton 3 xilinx FPGA.
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Xilinx In-System Programming Using an Embedded Microcontroller xapp058.pdf
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基于Xilinx ISE的的模块化FPGA设计示例
基于Xilinx ISE的的模块化设计示例
下面是本人初学时关于模块化设计写的一篇博文，实例也都是自己写的，希
望给大家一个参考，代码可能还不够规范
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XILINX CPLD_FPGA 并口下载线的原理图
XILINX CPLD_FPGA 并口下载线的原理图
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使用Xilinx Webpack4.2 ISE实现CPLD和FPGA设计
可编程逻辑器件cpld 和fpga 以及xilinx webpack 4.2 ISE 的介绍;用xilinxwebpack 4.2 ISE 设计七段译码器的显示.
关键词 ASIC Xinlin
关键词 ASIC Xinlin
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用Xilinx_FPGA实现DDR_SDRAM控制器
·摘要： DDB SDRAM使用双倍数据速率结构,它能获得比SDRAM更高的性能.DDR SDRAM需要特定的DDB控制器才能完成与DSP、FPGA之间的通信.由于Xilinx VirtexTM
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MiniSTM32开发板-定时器中断实验教程
这一节，我们将向大家介绍如何使用STM32的通用定时器，STM32的定时器功能十分强大，有TIME1和TIME8等高级定时器，也有TIME2~TIME5等通用定时器，还有TIME6和TIME7等基本定时器。在《STM32参考手册》里面，定时器的介绍占了1/5的篇幅，足见其重要性。这一节，我们选择难度适中的通用定时器来介绍。本节分为如下几个部分：
3.7.1 STM32通用定