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linux下的入侵检测的代码

我也不是什么高手,仅供大家交流参考
2013-12-04 16:09:01 下载 24 查看 1,030
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TFormDesigner allows you move and resize any control on your form. You need not prepare your form to

Just place TFormDesigner into your form, set Active property to True and enjoy!
2014-01-09 03:33:01 下载 115 查看 1,100
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比尔。盖茨何许人也?他如此年轻就享誉全球

他如此年轻就享誉全球,取得如此巨大的成就,靠的究竟是什么
2014-01-24 07:46:16 下载 131 查看 1,036
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这是一部关于李嘉诚的传记

这是一部关于李嘉诚的传记,内容很精彩,但是是什么开发环境就不清楚了 是exe格式的
2014-01-16 16:52:10 下载 53 查看 1,087
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Proteus常用中英文对照

单片机仿真常用到Proteus软件,其中的英文单词是什么意思呢,请看该文,对您帮助极大
2023-12-06 11:10:01 下载 1 查看 188
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手机游戏开发

讲述了我也不是到是什么玩意的东西,这个网站真他们的有病,太麻烦了,告噶基金大幅减少
2024-05-30 15:40:01 下载 10 查看 6,248
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win7使用答疑3000条

我电脑在WIN7下老是突然关机,像停电一样的突然关机,不知道是什么原因.
2025-06-21 03:10:02 下载 3 查看 9,782
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CAN控制器

FPGA实现CAN控制器,Verilog HDL编写代码
2018-12-19 21:41:34 下载 1 查看 23
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秒表

通过Verilog HDl语言设计数字秒表,设计灵活。
2024-09-15 10:40:01 下载 10 查看 7,110
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fifo源码 含testbench

基于Quartus的FIFO设计 Verilog HDL语言 含testbench
2025-05-30 13:20:02 下载 6 查看 242
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hzwjy2100

秒表设计 verilog hdl quartusii 9.0 modelsim 仿真平台
2025-11-17 14:52:56 下载 8 查看 440
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基于Altera公司系列FPGA(Cyclone EP1C3T144C8)、Verilog HDL、MAX7219数码管显示芯片、4X4矩阵键盘、TDA2822功放芯片及扬声器等实现了《电子线路设计&

基于Altera公司系列FPGA(Cyclone EP1C3T144C8)、Verilog HDL、MAX7219数码管显示芯片、4X4矩阵键盘、TDA2822功放芯片及扬声器等实现了《电子线路设计•
2015-09-27 20:13:01 下载 126 查看 1,445
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有实验结果,用MOSIN6编写的,是Verilog HDL语言实现的. 练习三 利用条件语句实现计数分频时序电路 实验目的: 1. 掌握条件语句在简单时序模块设计中的使用; 2. 学习在Ver

有实验结果,用MOSIN6编写的,是Verilog HDL语言实现的. 练习三 利用条件语句实现计数分频时序电路 实验目的: 1. 掌握条件语句在简单时序模块设计中的使用; 2.
2016-11-19 10:46:02 下载 181 查看 1,471
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本文介绍了乐曲演奏电路的设计与实现中涉及的CPLD/FPGA可编程逻辑控件,开发环境MAX+PLUSⅡ,硬件描述语言HDL以及介绍了在MAX+PLUSⅡ的EDA 软件平台上, 一种基于FPGA 的乐曲

本文介绍了乐曲演奏电路的设计与实现中涉及的CPLD/FPGA可编程逻辑控件,开发环境MAX+PLUSⅡ,硬件描述语言HDL以及介绍了在MAX+PLUSⅡ的EDA 软件平台上, 一种基于FPGA 的乐曲发生器的设计方法
2014-02-01 17:30:01 下载 42 查看 1,122
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中学物理教学法作业习题

绪  论
1.中学物理教学法的性质是什么
中学物理教学法是一门由物理学、教育学、心理学、哲学和现代科学技术有机结合的
综合学科。
2.中学物理教学法的研究对象是什么
2023-12-16 10:10:01 下载 10 查看 6,906
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正则表达式的一个小例子

正则表达式的一个小例子,利用正则表达式判断文件中的字符是什么类型的。
2013-12-29 20:02:01 下载 110 查看 1,105
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LCD1602.rar

Verilog HDL语言的LCD1602液晶驱动程序
2013-04-24 16:38:15 下载 30 查看 1,169
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十六位超前进位加法器

十六位超前进位加法器,Verilog HDL
2015-09-21 10:51:01 下载 79 查看 1,122
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先入先出缓冲存储器

先入先出缓冲存储器,采用verilog hdl
2016-12-19 00:34:01 下载 148 查看 1,070
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FIFO 源程序

FIFO 源程序,verilog HDL实现,自己验证过,没问题
2013-12-19 14:10:05 下载 40 查看 1,014
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