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基于CPLD/FPGA的IP核设计
本文介绍了一个基于CPLD／FPGA的嵌入式IP核设计。论文在阐述可编程逻辑器件及其发展趋势的基础上，探讨了知识产权复用理念，MCU的复杂化设计以及数字信号传输与处理的速度要求。
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使用LabVIEW FPGA模块设计IP核
基于已经验证的设计进行代码模块开发，将使现有IP在未来应用中得到更好的复用，也可以使在不同开发人员和内部组织之间进行共享和交换的代码更好服用
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UG157 LogiCORE IP Initiator/Ta
UG157 - LogiCORE™ IP Initiator/Target v3.1 for PCI™ 入门指南
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VS1003 网络IP电话方案
随着多媒体时代的深入，各种令人眼花缭乱的视频显示技术迅猛发展，与此同时，层出不穷的新兴应用也对产品音频性能提出了更高的要求，比如用电脑直接拨打IP电话、进行视频会议、仪器操作语音控制等场合都需要高质量的语音效果
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TCP_IP路由技术学习手册
RIP 作为一种距离矢量协议，从开发到现在一直沿用至今，虽然现在使用比较少。但是RIP 还是小型企业使用比较多的，以其配置简单，易于管理等特点。
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使用LabVIEW FPGA模块设计IP核
基于已经验证的设计进行代码模块开发，将使现有IP在未来应用中得到更好的复用，也可以使在不同开发人员和内部组织之间进行共享和交换的代码更好服用
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UG157 LogiCORE IP Initiator/Ta
UG157 - LogiCORE™ IP Initiator/Target v3.1 for PCI™ 入门指南
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vivado Final_IP+Integrator视频演示
为了解决实现的瓶颈，Vivado 工具采用层次化器件编辑器和布局规划器、速度提升 了3 至 15 倍且为 SystemVerilog 提供业界领先支持的逻辑综合工具、速度提升 了4 倍且确定性更高的布局布线引