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经典spi IP 核心 FPGA是实现有说明文档
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Actel FPGA A3P600最小系统原理图
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Video信号pal制转vga输出，fpga Verilong语言编写
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UART FPGA实现过程文档说明，及VERILOG HDL代码
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FPGA设计的SDRAM控制器，有仿真代码，已通过验证
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FPGA的入门级资料 讲的很好 不错 hdlc的实现
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用verilog实现的串口收发数据程序，已经调试通过
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xilinx官方推出的基于xilinx FPGA的PCIE设计的教程
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基于altera fpga 的单口ram ip核的应用实例
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Xilinx Spartan6开发板原理图及PCB图
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XILINX CPLD_FPGA 并口下载线的原理图
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fpga axi测试程序,可测试符合axi协议的ip核
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