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C51 Timer 0 的使用
Timer_0_mode_0_counter_gate_soft
2014-01-20 17:02:12
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C51 Timer 0 的使用
Timer_0_mode_0_timer_gate_hard
2016-10-07 20:56:01
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C51 TIMER 0的使用
Timer_0_mode_0_timer_gate_soft
2016-10-07 20:58:01
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将计数器0设置为方式0，计数器初值设为0H~FH，用手动逐个输入单脉冲，编成使计数值在屏幕上显示，并同时用逻辑笔观察OUT0点平变化。程序如下：
2014-11-03 16:00:05
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基于新唐M0 0耗时按键（大叔的助学板上）
2023-04-26 02:20:02
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DESProcess
FILE *mfp,*cfp
int ttch=0,xorRes,ttbitdiff=0
char mch,cch
float bdiff=0
if(
2016-07-02 20:25:01
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孙子兵法原文+译文+三十六计译文 岁月带给我们的是什么?难道
2015-08-19 00:34:02
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什么 是什么是马上 是水磨石什么什么实际上计划 划时代计划
2013-12-11 20:57:02
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3W原则
在PCB设计中为了减少线间串扰，应保证线间距足够大，当线中心间距不少于3倍线宽时，则可保持大部分电场不互相干扰，这就是3W规则。3W原则是指多个高速信号线长距离走线的时候，其间距应该遵循3W原则，例如时钟线，差分线，视频、音频信号线，复位信号线及其他系统关键电路需要遵循3W原则，而并不是板上所有的布线都要强制符合3W原则。
满足3W
2021-11-08 01:30:02
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Design Compiler 2007。新版本扩展了拓扑技术，以加速采用先进低功耗和测试技术的设计收敛，帮助设计人员提高生产效率和 IC 性能。
2013-05-29 23:50:02
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SoPC Builder在一个工具中实现了嵌入式系统各个方面的开发，包括软件的设计和验证，为充分利用SoPC技术提高电子系统的性能和降低成本提供了强有力的支持。
2013-06-02 01:00:02
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Summit Design公司基于ESL设计产品的最新Visual Elite图像产品具有Advanced SystemC建模及分析功能。该工具的最新版本包括原始SystemC构造，允许用户在SystemC内建模并验证设计。 该工具的HDL版本可帮助门级设计师们学习用Verilog和VHDL设计。最新版本的Visual Elite可帮助硬件设计师们和C/C++编程者迅速使用SystemC语言创建系
2013-04-24 16:38:40
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pl0，用C写的，短小精悍，还有实例！详细注解
2014-01-09 22:08:01
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PL/0源码，国外牛人所写，一本经典教科书《程序语言实践之路》所带源码
2015-05-17 00:29:01
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0表示空，在源码中修改所想要测试的数独表。
还有JAVA计算数独的源码
2016-08-17 00:50:02
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Summit Design公司基于ESL设计产品的最新Visual Elite图像产品具有Advanced SystemC建模及分析功能。该工具的最新版本包括原始SystemC构造，允许用户在SystemC内建模并验证设计。 该工具的HDL版本可帮助门级设计师们学习用Verilog和VHDL设计。最新版本的Visual Elite可帮助硬件设计师们和C/C++编程者迅速使用SystemC语言创建系
2023-06-06 16:20:31
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SoPC Builder在一个工具中实现了嵌入式系统各个方面的开发，包括软件的设计和验证，为充分利用SoPC技术提高电子系统的性能和降低成本提供了强有力的支持。
2023-06-06 17:50:03
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Design Compiler 2007。新版本扩展了拓扑技术，以加速采用先进低功耗和测试技术的设计收敛，帮助设计人员提高生产效率和 IC 性能。
2023-06-06 20:30:02
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此源码是在C8051F120串口通信的源程序
能采用串口调试助手
2023-12-21 02:40:01
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fm0 encoder and coder
2024-01-14 02:40:01
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