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完整的数字频率计程序 完整的数字频率计程序
6f952be80af8b70d35716982e37a4568-1.
2023-08-24 02:00:01
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UART FPGA实现过程文档说明,及VERILOG HDL代码
6f27c2171fc9
2023-09-04 12:00:01
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FPGA的入门级资料 讲的很好 不错 hdlc的实现
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2023-09-04 12:50:01
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用verilog实现的串口收发数据程序,已经调试通过
6c119743ccaa95dca5-1.
2023-09-04 14:50:01
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基于FPGA的蓝牙数据采集系统 基于FPGA的蓝牙数据采集系统
6f288cbd20cec85a92fa0cba0
2023-09-04 16:40:01
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p>基于VHDL的时钟设计(de2开发平台) 基于VHDL的时钟设计(de2开发平台)
6bd7daeaabc237140
2023-09-05 05:00:02
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fpga axi测试程序,可测试符合axi协议的ip核
6ec69-1
2023-09-05 12:30:01
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高速ADC及DAC接口的参考设计
6a4ff491cc0fb4ef15b123d1f2c81c9-1.png" alt="
2023-09-05 16:30:02
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ALTERA公司的CYCLONE FPGA开发板详细原理图
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2023-09-05 20:50:01
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两个自己做的FPGA项目 两个自己做的FPGA项目
6da1e8846420bb952d292d49687a3a
2023-09-05 21:20:01
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FPGA结合DSP设计,如FIR、IIR滤波器
6ebb867bec2d28c8066b80c0-1.png
2023-09-08 20:30:01
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自行开发的示波器FPGA代码,可以实现示波器的DIY
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2023-09-09 13:00:02
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6df120eca0-1.png" alt="FPGA的学习,熟悉QuartusII
2023-09-10 18:00:01
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Actel FPGA A3P030 数字比较器的源码
6d3/426cbcc97a23faaf5661d7f564e766d3-1.png" alt
2023-09-14 02:00:01
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电力电网应用-面向未来的智能电网
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2023-09-18 09:20:01
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SA68D21DL是一种可在微机或单片机之间进行全双工无线通信的数传收发模块,该模块具有透明式数据传输、与上位机接口简单方便、通信距离较远、数据误码率低、可独立工作、可组网应用等特点.文中介绍了SA6
2023-11-27 13:20:02
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系统以西门子WinCC V6 为软件平台,设计开发
2024-01-22 11:30:02
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本文通过嵌入式结构网络设备̣:一款IPV6 核心路由器,系统地介绍了分布式系统中
嵌入式结构网络设备地址的动态配置方法,该方法结合了F1ash 和只读存储器的灵活应用,有效地克服静态配
2024-03-03 14:10:01
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高压无功补偿兼滤波装置主要用于6kV、10kV及35kV供电的冶金化工等行业有谐波源的场所。本装置为“无源型”滤波装置,主要由滤波电容器、滤波电抗器和电阻器适当组合,精密调谐后使滤波器对某一频率
2024-03-04 00:50:01
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控改造部分题目如下共6 个题目,由指导教师任选其中之一。专用夹具设计以本
次毕业实习
2024-03-16 15:20:01
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