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为了保证该设计的可靠性，首先是进行编译码的算法验证；其次通过在FPGA的集成设计环境QuartusⅡ软件中完成HDB3码的编译、综合、仿真等步骤，通过下载电缆下载到特定的FPGA芯片上，用逻辑分析仪进行时序仿真
2023-06-11 20:01:11
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整个设计利用ALTERA公司提供的QUARTUSⅡ4.0开发软件，采用先进的层次化设计思想，使用一片FPGA芯片完成了整个FFT处理器的电路设计。
2023-06-13 15:30:29
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设计中，通过QuartusⅡ、ModelSim和Protel 99等电子设计自动化开发工具完成了一个高性能嵌入式软硬件系统的设计及仿真验证；采用了实用小巧的嵌入式实时操作系统μC／OS-Ⅱ，为应用系统的实时性提供了保证
2023-06-15 06:30:06
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协议标准,设计了(2,1,6)卷积码Viterbi译码器,采用串行方式进行回溯译码,利用双口RAM存储路径度量和幸存信息.电路使用Verilog HDL语言进行描述,ModelSim软件进行功能仿真,Quartus
2023-06-26 16:40:03
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根据FPGA的高速并行处理能力和全硬件实现的特点，采用直接序列扩频技术，借助QuartusⅡ6.0及Protel99se工具，完成了系统的软件仿真和硬件电路设计。
2023-06-27 02:30:03
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在Quartus II环境下，采用模块化设计思想，借助Verilog语言及调用FPGA内部IP核完成了系统逻辑设计，包括：12C配置模块、有效数据提取模块、灰度分量提取模块、帧缓存模块、图像算法处理模块
2023-09-26 10:20:02
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首先用Matlab7．1对部分模块进行了软件仿真；然后用硬件描述语言Verilog HDL在QuartusⅡ8．0环境下完成了关键模块的编写、仿真和综合，最后详细阐述了OFDMA上行链路信道估计与均衡的
2023-09-28 14:30:01
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运用QuartusⅡ软件对verilog代码进行编译和调试，通过试验验证了相关算法在FPGA上实现的可能。并部分实现了代码的优化和处理，给出了算法实现的具体方式，达到了速度测量的目的。
2023-09-30 22:30:02
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首先介绍了语音编码研究的发展状况以及低速率语音编码研究的意义，接着在对MELP算法进行深入分析的基础上，提出了利用DSP Builder在Matlab中建模的思路及实现过程，最后本文把重点放在MELP声码器的编解码器设计上，利用DSP Builder、QuartusⅡ
2023-10-01 14:10:01
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设计中，通过QuartusⅡ、ModelSim和Protel 99等电子设计自动化开发工具完成了一个高性能嵌入式软硬件系统的设计及仿真验证；采用了实用小巧的嵌入式实时操作系统μC／OS-Ⅱ，为应用系统的实时性提供了保证
2023-10-03 13:00:01
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设计中采用了ALTERA 公司的Quartus Ⅱ 6.0 开发软件，芯片选择Stratix系列的EP1S20B672C6。
2023-10-03 16:00:02
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为了保证该设计的可靠性，首先是进行编译码的算法验证；其次通过在FPGA的集成设计环境QuartusⅡ软件中完成HDB3码的编译、综合、仿真等步骤，通过下载电缆下载到特定的FPGA芯片上，用逻辑分析仪进行时序仿真
2023-10-04 03:30:01
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通过研究FPGA技术及应用，基于FPGA利用Quartus Ⅱ6.0平台实现了开环基音搜索、闭环基音搜索2个关键环节。通过自顶向下及模块化设计思想，将运算及硬件资源消耗分散到各模块中。
2023-10-04 03:40:01
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协议标准,设计了(2,1,6)卷积码Viterbi译码器,采用串行方式进行回溯译码,利用双口RAM存储路径度量和幸存信息.电路使用Verilog HDL语言进行描述,ModelSim软件进行功能仿真,Quartus
2024-01-05 08:20:01
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首先介绍了语音编码研究的发展状况以及低速率语音编码研究的意义，接着在对MELP算法进行深入分析的基础上，提出了利用DSP Builder在Matlab中建模的思路及实现过程，最后本文把重点放在MELP声码器的编解码器设计上，利用DSP Builder、QuartusⅡ
2024-03-02 14:40:01
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根据FPGA的高速并行处理能力和全硬件实现的特点，采用直接序列扩频技术，借助QuartusⅡ6.0及Protel99se工具，完成了系统的软件仿真和硬件电路设计。
2024-03-04 02:40:01
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设计中采用了ALTERA 公司的Quartus Ⅱ 6.0 开发软件，芯片选择Stratix系列的EP1S20B672C6。
2024-03-25 14:30:01
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通过研究FPGA技术及应用，基于FPGA利用Quartus Ⅱ6.0平台实现了开环基音搜索、闭环基音搜索2个关键环节。通过自顶向下及模块化设计思想，将运算及硬件资源消耗分散到各模块中。
2024-04-03 14:10:01
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最后使用QuartusⅡ将整个系统工程文件综合、布局布线。在察看时序报告无误后，将系统配置文件下载至FPGA开发板中。
2024-04-25 20:50:01
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其次，在了解PCI规范的前提下，深入地分析了PCI时序和地址配置空间等，设计了简化逻辑的状态机，并用VHDL硬件描述语言设计了程序，完成了简化逻辑的PCI接口设计在FPGA芯片内部的实现，达到了一33MHz
2023-06-12 04:00:04
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