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在Quartus Ⅱ开发环境下，使用Altera公司FPGA芯片，采用VHDL，语言设计并实现了上述模块。
2023-10-01 05:30:01
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Field Programmable Gate Array，FPGA)为平台的硬件设计实现方案，采用超高速集成电路硬件描述语言(VHSIC Hardware Description Language，VHDL
2023-10-01 06:40:01
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基于这种混沌变形DES算法，提出了以现场可编程门阵列(FPGA)为平台的硬件设计实现方案，依据自顶向下的模块设计方法，根据其特有硬件结构，采用硬件描述语言(VHDL)完成了整个系统的设计，通过了仿真与适配
2023-10-01 18:30:01
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文章的最后，结合系统设计给出几种VHDL优化方法，主要围绕系统的速度、结构和面积等问题展开讨论。
2023-10-02 08:20:01
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采用Verilog硬件描述语言实现旁路FIFO；采用VHDL硬件描述语言来实现Aurora链路层模块。
2023-10-03 04:40:01
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提出了以现场可编程门阵列 (Field Programmable Gate Array，FPGA)为平台的硬件设计实现方案，采用硬件描述语言 (VHSIC Hardware DescriptionLanguage，VHDL
2023-10-03 15:40:02
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利用FPGA器件实现DRFM的控制器和多路采样数据缓冲器，采用硬件描述语言(Very High Speed}lardware Description Language VHDL)实现了DRFM电路的FPGA
2023-10-05 04:20:01
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为了最大限度地提高谐波检测的速度，算法的实现采用并行的乘法运算单元结构和并行的存储分配方法；A/D采样控制电路、数字锁相环和基-4 FFT处理器等均用VHDL语言实现。
2023-10-05 06:00:01
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其硬件平台的核心部分是Altera公司Stratix系列的．FPGA EPlS40芯片，采用自顶向下的设计方法构造图像增强处理功能模块，利用硬件描述语言vHDL对图像增强模块进行电路描述，并进行设计优化
2023-10-06 06:50:01
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通过Link for Modelsim工具，实现MATAB与Modelsim之间对VHDL代码的联合仿真测试，通过在线逻辑分析工具ChipScope，完成系统的片上测试，并分析系统的性能，证明系统的可实用性
2023-10-07 12:20:01
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在系统设计的过程中，本文以Altera公司的FPGA芯片EPF10K70RC240-2为核心，利用开发工具MAX+PLUSⅡ并结合硬件描述语言VHDL设计了一种频率、相位、幅度、谐波比例可调的谐波信号发生器
2023-10-07 13:10:01
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利用硬件描述语言VHDL和Altera公司高性能的EDA设计平台QuartusII5.0，采用Altera公司型号为EP2C8Q208C8的FPGA芯片，设计了数据采集系统的核心控制硬件和软件，完成了从模块划分
2023-10-07 22:10:01
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我们在设计中采用了层次化、模块化的设计思想，将整个滤波器划分为多个功能模块，利用VHDL语言进行了各个功能模块的设计。
2023-10-10 02:30:01
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然后着重研究了FPGA的设计方法和设计流程，在设计中采用了层次化、模块化的设计思想，将整个滤波器划分为多个功能模块，利用VHDL语言编程和原理图两种设计技术进行了ⅡR滤波器的各个功能模块的设计，采用EPlCl2Q240
2023-10-31 22:40:01
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最后用VHDL语言对基带处理器中的核心部件数FFT部件进行了IP模块化设计。模块实现了标准化、参数化。不仅可以用在无线局域网系统中，同时也可以应用于其他采用OFDM技术的传输系统中。
2023-11-01 00:10:02
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使用Altera公司的ACEX1K系列FPGA，整个系统由VHDL语言编程，开发软件为MAX+PLUSⅡ。
2023-11-01 21:50:01
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中算术编码的硬件实现问题,给出了一种硬件最优化的算术编码实现方案.最后使用硬件描述语言(Very High Speed Integrated Circuit Hardware Description Language,VHDL
2024-01-03 05:20:02
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其软件和硬件对计算环境的适应性强,性能稳定,密钥建立时间优良,密钥灵活性强.存储需求量低,即使在空间有限的环境使用也具备良好的性能.在分析高级加密标准算法原理的基础上,描述了圈变换及密钥扩展的详细编制原理,用硬件描述语言(VHDL
2024-01-22 09:10:01
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"单片机+CPLD/FPGA体系结构"的集成化设计方案:①在CPLD中实现信号音分频和计时频率生成电路、20路用户LED状态控制电路;②CPLD与单片机以总线接口方式实现译码、数据和控制信号锁存功能的VHDL
2024-01-29 15:10:01
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文章给出了各个模块的具体建模与设计，系统采用的是FPGA技术来实现数据采集和信号处理，采用VHDL实现了数字复接器和分接器、编解码器、调制与解调模块的建模与设计。
2024-01-31 18:20:01
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