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在此基础上本文将提出的改进小波邻域阈值去噪算法进行了相应的简化，以满足低噪声处理要求且易于在FPGA上实现；最后，给出了基于 FPGA的小波邻域阈值去噪系统的总体结构和FPGA内部各功能模块的具体实现方案，包括二维离散小波变换模块、二维离散小波逆变换模块、SDRAM
2013-05-16 02:00:02
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在此基础上本文将提出的改进小波邻域阈值去噪算法进行了相应的简化，以满足低噪声处理要求且易于在FPGA上实现；最后，给出了基于 FPGA的小波邻域阈值去噪系统的总体结构和FPGA内部各功能模块的具体实现方案，包括二维离散小波变换模块、二维离散小波逆变换模块、SDRAM
2023-06-06 13:20:03
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本文旨在研制和开发一套应用于电梯的智能多媒体显示与远程监控系统，硬件设计中，在以嵌入式微处理器S3C2410X、Flash、SDRAM构成的最小系统核心板外，扩展了串行口、网口、LCD接口等外围硬件资源
2023-06-18 02:00:05
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该系统硬件资源包括S3C44BOX，Flash，SDRAM，UART，以太网控制器以及LCD接口等；软件方面，针对硬件平台完成Bootloader移植和μClinux移植，并完成嵌入式监控终端和上位机应用程序的设计
2023-11-30 06:30:01
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本课题在充分考虑系统实用性和开发成本的基础上，采用EM8623芯片为CPU，片外扩展FLASH和SDRAM存储器。
2023-12-05 19:10:01
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接着论文提出了基于FPGA的帧内预测系统的设计方案，将前段采集剑的RGB图像通过色度转换模块转换成YCbCr图像，存入片外SDRAM中，控制模块负责读写数掘送入帧内预测模块进行处理。
2024-04-15 20:40:01
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18. sdram的verilog的源码实现.
19. 嵌入式系统.
20. PALM PDB文件阅读器源代码.
21. IRDA 1.0 标准协议源代码.
2015-04-24 09:50:54
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规则排列在FPGA上,通过对T<,B>的控制端的不同配置来实现纠错码的各个功能单元;在可重构基核的基础上提出了纠错码重构电路的嵌套式GA理论模型,将嵌套式GA的染色体串作为进化硬件描述语言,通过转换为相应的VHDL
2013-07-01 03:10:01
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通用阵列逻辑GAL实现基本门电路的设计
一、实验目的
1.了解GAL22V10的结构及其应用；
2.掌握GAL器件的设计原则和一般格式；
3.学会使用VHDL
2013-11-17 03:16:02
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T规则排列在FPGA上,通过对T的控制端的不同配置来实现纠错码的各个功能单元;在可重构基核的基础上提出了纠错码重构电路的嵌套式GA理论模型,将嵌套式GA的染色体串作为进化硬件描述语言,通过转换为相应的VHDL
2024-01-23 03:20:01
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多种设计输入方法
– Quartus II
• 原理图式图形设计输入
• 文本编辑
– AHDL, VHDL, Verilog
• 内存编辑
.
2015-04-24 09:50:57
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该系统采用4片XC3SD1800A作为处理核心，使用DDR2 SDRAM高速存储实时数据。作者通过全面的分析，设计了核心板、底板和应用板分离系统架构。
2013-05-27 15:50:01
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硬件方面，在S3C2440A的基础上扩展了NANDFlash、NORFlash、SDRAM、LCD触摸屏模块，并设计了X、Y轴电机及其驱动电路。
2013-06-28 05:30:01
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(3) 根据智能家居的功能要求，设计了一种智能家居中的安防系统，论述了ARM9嵌入式微处理器S3C2410的原理以及性能，阐述了安防系统中的NANDFLASH模块、SDRAM模块、RS232串口模块、以太网模块
2013-04-24 16:38:34
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该系统采用4片XC3SD1800A作为处理核心，使用DDR2 SDRAM高速存储实时数据。作者通过全面的分析，设计了核心板、底板和应用板分离系统架构。
2023-06-27 11:50:28
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根据控制系统的要求，分析了控制系统的组成结构和输入输出信号，在此确立了其型号和硬件配置，这里采用嵌入式微处理器Samsung S3C2410X为控制核心，详细地设计了双馈风电机组本地控制器的硬件电路，包括SDRAM
2023-09-26 16:00:02
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硬件方面，在S3C2440A的基础上扩展了NANDFlash、NORFlash、SDRAM、LCD触摸屏模块，并设计了X、Y轴电机及其驱动电路。
2023-11-09 08:40:02
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(3) 根据智能家居的功能要求，设计了一种智能家居中的安防系统，论述了ARM9嵌入式微处理器S3C2410的原理以及性能，阐述了安防系统中的NANDFLASH模块、SDRAM模块、RS232串口模块、以太网模块
2024-02-09 18:30:01
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在理论分析和仿真的基础上，论文设计了基于TMS320F2812 DSP的控制系统，并结合原理图介绍了各模块运行原理；重点分析了如何利用CPLD来实现时序控制的功能，并给出了VHDL设计的程序和仿真结果。
2013-04-24 16:38:20
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使用硬件描述语言VHDL对各功能模块进行逻辑和行为描述，最终实现在FPGA中，使其能够完成1553B数据码的接受、发送、转换和与处理器的信息交换等功能。
2013-04-24 16:38:21
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