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数字信号处理的FPGA实现
本书共分8章，主要内容包括典型fpga器件的介绍、vhdl硬件描述语言、fpga设计中常用软件简介、用fpga实现数字信号处理的数据规划、多种结构类型的fir数字滤波器的fpga
2013-06-04 20:00:01
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为了减少被测电路内部节点的开关翻转活动率，研究了一种随机单输入跳变（Random Single Input Change，RSIC）测试向量生成器的设计方案，利用VHDL语言描述了内建自测试结构中的测试向量生成模块
2013-10-08 01:24:01
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它采用硬件模块化的现代EDA设计方法，使用
VHDL硬件描述语言，实
现了永磁同步电机矢量控制系统的设计。
2022-08-16 00:40:01
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4、 可以使用GW48－PK2上的12MHz作为输入时钟信号
通过可编程逻辑器件（PLD）和VHDL硬件描述语言来实现电子琴的基本要求。
2022-08-25 20:30:02
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MS-DOS Style, NSIS, Normal text, Objective-C, Pascal,Python, Javascript,Verilog,Haskell,InnoSetup,CMake,VHDL
2023-01-02 10:40:02
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数字信号处理的FPGA实现
本书共分8章，主要内容包括典型fpga器件的介绍、vhdl硬件描述语言、fpga设计中常用软件简介、用fpga实现数字信号处理的数据规划、多种结构类型的fir数字滤波器的fpga
2023-05-05 03:30:02
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本文首先介绍定点数和浮点数的格式，完成基于FPGA的几种常用浮点运算器的VHDL设计，包括浮点数与定点数之间的相互转换，浮点加法器、减法器、乘法器以及除法器。
2023-06-12 05:10:03
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系列单片机被公认为8位机的工业标准,因此,使用FPGA模拟实现8051单片机及其外设的功能便成为大规模复杂数字系统设计中的重要课题.该文首先介绍了FPGA及Xilinx公司关于硬件设计开发的工具ISE系统,继而用VHDL
2023-06-15 04:50:12
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本文介绍了π/4-DQPSK调制解调的基本原理和各个模块的设计实现；完成了调制解调算法的Matlab仿真设计；采用VHDL硬件描述语言在Xilinx公司的ISE5.2开发环境下设计实现各个模块，通过了时序仿真
2023-06-24 07:50:03
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本文首先介绍定点数和浮点数的格式，完成基于FPGA的几种常用浮点运算器的VHDL设计，包括浮点数与定点数之间的相互转换，浮点加法器、减法器、乘法器以及除法器。
2023-06-26 06:10:03
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采用FPGA实现小波变换与使用DSP处理器的“DSP+ASIC”方案相比，具有速度快，数据宽度可任意设置的特点，并且VHDL语言具有可移植性的特点，具有更强的通用性。
2023-09-24 08:20:01
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最后以Altera公司的Stratix系列芯片EP1S10484C5为硬件平台，以QuarusII6.0为软件平台，利用VHDL语言描述的方式，分别用单蝶形和双蝶形两种设计方案，实现了适用于IEEE802.11a
2023-09-28 16:10:01
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采用FPGA实现小波变换与使用DSP处理器的“DSP+ASIC”方案相比，具有速度快，数据宽度可任意设置的特点，并且VHDL语言具有可移植性的特点，具有更强的通用性。
2023-10-03 08:10:01
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在此基础上，运用VHDL语言进行了FPGA部分的功能实现，给出了一些相关的仿真及测试结果。最后对该系统还需进一步研究的问题进行了简要的介绍，对调试过程中的出现的一些问题进行了简单的分析和小结。
2023-10-08 04:20:01
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并着重对系统级芯片内部模块化设计进行了论述.在设计中采取了按功能分割各个模块方法,并分别对测试系统的各个模块进行设计.以对指示空速Vi的测试系统作为设计的主干线,详细地论述了测试指示空速Vi的系统组成及各个模块之间关系.由于所有的模块均采用VHDL
2024-01-17 20:10:01
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在此基础上，运用VHDL语言进行了FPGA部分的功能实现，给出了一些相关的仿真及测试结果。最后对该系统还需进一步研究的问题进行了简要的介绍，对调试过程中的出现的一些问题进行了简单的分析和小结。
2024-03-12 18:50:01
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采用FPGA实现小波变换与使用DSP处理器的“DSP+ASIC”方案相比，具有速度快，数据宽度可任意设置的特点，并且VHDL语言具有可移植性的特点，具有更强的通用性。
2024-04-01 05:30:01
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系列单片机被公认为8位机的工业标准,因此,使用FPGA模拟实现8051单片机及其外设的功能便成为大规模复杂数字系统设计中的重要课题.该文首先介绍了FPGA及Xilinx公司关于硬件设计开发的工具ISE系统,继而用VHDL
2024-12-28 11:30:02
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本文结合水声图像特点，应用VerilogHDL 语言在Quartus Ⅱ软件环境下设计实现了JPEG基本模式编解码器。
2013-05-25 13:50:01
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首先用Matlab对整个16QAM系统进行了软件仿真；然后用硬件描述语言Verilog HDL在QuartusⅡ环境下完成了系统关键算法的编写、行为仿真和综合，最后详细阐述了异步串口(UART)的FPGA
2013-04-24 16:38:23
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