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FPGA自学 黑金CYCLONE-IV AX515开发板网盘资料
p>这是开发板资料，不是开发板，做硬件的可以参考里面的原理图和PCB，做软件的可以移植里面的工程
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水声信号功率放大器的设计与实现
该电路以单片机AT89C52，集成6阶巴特沃思低通滤波芯片MF6以及大功率运算放大器LM12为核心，通过标准RS232接口与PC进行通信，实现信号增益的程控调节，对干扰信号具有良好的抑制作用。
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Findstr.cpp运行结果: GetNext-IndexKMP的结果: 输入主串s:acabaabcaabaabcac 输入模式串t:abaabcac 主串s长=17 模式串t长=8
:abaabcac
主串s长=17
模式串t长=8
next[0]=-1 next[1]=-1 next[2]=0 next[3]=0 next[4]=1
next[5]=-1 next[6]
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用汇编语言编写的一个简单的学生成绩管理系统
用汇编语言编写的一个简单的学生成绩管理系统，用户有6种选择：
（1） 按’m’，则显示功能菜单。
（2） 按’L’，则显示学生姓名和各学科成绩（数学，英语，语文）。
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一、 设计目的及所需设备： 了解PC机串行口的使用；所需设备为：PC机
232C接口标准：
(1) 引脚1：CD，载体检测；
(2) 引脚2：RXD，接收数据；
(3) 引脚3：TXD，发送数据；
(4) 引脚4：DTR，终端准备好；
(5) 引脚5：信号地；
(6)
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1) Write a function reverse(A) which takes a matrix A of arbitrary dimensions as input and returns a
Thus for example, if
A = 1 2 3 then B = 3 2 1
4 5 6 6 5 4
7 8 9 9 8 7
Write a main program
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Essential Linux Device Drivers by Sreekrishnan Venkateswaran ---------------------------------------
---------------------- Publisher: Prentice Hall Pub Date: March 27, 2008 Print ISBN-10: 0-13-239655-6
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信息论是由通信技术、概率论、随机过程和数理统计等相结合逐步发展而形成的一门新兴科学。其奠基人是美国数学家香农
压缩包内含有6个ppt文件，每个ppt自成一章:1绪论、2信源及其熵、3信道及其容量、4信息率失真函数、5信源编码、6信道编码。是初学信息论的最好材料。
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（1）S2S1=00时
，触发器的状态一次0→1→2→0；
（2）S2S1=01时，实现模5计数，触发器的状态一次0→1→2→3→4→0；
(3) S2S1=10时，实现模7计数，触发器的状态一次0→1→2→3→4→5→6→
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本项目将一组128位主密钥0123456789abcdeffedcba9876543210（16进制）通过4轮密钥扩展
0123456789abcdeffedcba9876543210（16进制）通过4轮密钥扩展，获得前4轮子密钥，4轮子密钥再通过数码管分8批按16进制循环显示，该4轮子密钥理论值应为：
f12186f9 41662b61 5a6ab19a
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89C51单片机设计多功能低频函数信号发生器
89C51单片机设计多功能低频函数信号发生器,能产生方波、正弦波、三角波等信号波形,并且用LCD1602显示频率
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新唐N76E003中文版规格书 ，Nuvoton 1T 8051-内核微控制器
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TCPIP入门经典第5版
全书分为6个部分，共24章：首先从TCP/IP基础知识开始；接着着重介绍了TCP/IP协议系统；然后介绍了TCP/IP连网的相关知识；第4部分对TCP/IP中使用的工具进行了讲解；第5部分是与Internet
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基于STM32的Dobot控制程序
本 Demo 是基于 STM32F103VET6 芯片编写，因此使用本程序时需要用户自行配备一块 STM32F103VET6 开发板。
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示波器1x10x功能
在示波器实际测量中的带宽一般指示波器带宽和探头组成的系统的一个综合带宽，而探头在1X档时的带宽只限制到6MHz，测量比6MHz高的信号会有很大的衰减，只有将探头打到10X(带宽达到全带宽)时的结果才是正确的
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基于多CPU控制的高压防爆开关综合保护系统的研究
· 摘要： 针对目前煤矿井下6 kV电网防爆开关存在载流能力小、保护简单、故障率高等问题,文章提出了一种基于多CPU控制的高压防爆开关综合保护系统的设计方案,分析了矿井6 kV高压电网故障保护的工作原理
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Xilinx FPGA设计进阶(提高篇)
Virtex_arch.PDF Ch3_fpga_design.PDF Ch4_HDL_Coding.PDF Ch5_Constraint.PDF Ch6_