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所有模块用Verilog语言设计，由Modelsim仿真和集成开发环境ISE9.1综合。仿真与综合结果表明，系统时钟频率最高达到106.7MHz。该设计在完成功能的基础上，能够较好地满足实时性要求。
2013-07-21 20:50:01
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赛灵思公司在 ISE™ 软件设计套件 10.1 版中包含了 PinAhead。 赛灵思公司开发了一种规则驱动的方法。
2022-03-28 15:30:01
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系统的软件设计采用Verilog HDL语言编程，在Xilinx ISE软件开发平台上完成编译和综合，并选用ModelSim SE 6.0完成了波形仿真。
2022-06-18 06:20:01
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首先基于对处理器功能和特点的分析,研究了FFT算法的选取和优化,并完成了处理器体系结构的设计；在此基础上,以提高处理器处理速度和减小硬件资源消耗为重点研究了具体的实现方案,完成了1.2万行RTL代码编程,并在XILINX公司提供的ISE
2023-06-13 05:20:04
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设计选取了Verilog HDL 作为硬件描述语言，利用Xilinx公司的ISE 开发平台，通过使用手工编写Verilog 程序与部分调用IP Core 相结合的方法，最终完成802.11b协议各个模块的设计
2023-09-27 02:20:01
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本设计的FPGA芯片采用Xilinx公司Virtex-II Pro系列产品--XC2VP70，设计平台采用Xilinx公司的ISE系列软件。
2023-10-01 08:20:02
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第三章主要讨论了论文中所用Xilinx公司Virtex-ⅡPro系列FPGA的性能、结构及其开发流程，并对其相应的开发平台ISE7.X和仿真工具ModelSim作了概括性的介绍。
2023-10-12 09:10:01
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本设计的FPGA芯片采用Xilinx公司Virtex-II Pro系列产品--XC2VP70，设计平台采用Xilinx公司的ISE系列软件。
2024-02-11 04:20:02
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所有模块用Verilog语言设计，由Modelsim仿真和集成开发环境ISE9.1综合。仿真与综合结果表明，系统时钟频率最高达到106.7MHz。该设计在完成功能的基础上，能够较好地满足实时性要求。
2024-04-15 20:40:01
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实验在XINLINX ISE操作平台上完成，用ModelSim SE进行功能仿真和时序验证，达到设计要求后，将程序下载到SPARTEN3E开发板上，通过控制LCD液晶屏显示结果。
2024-05-28 01:10:01
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● 支持文件系统FAT12 和FAT16 及FAT32
● 文件操作功能：新建、删除、读写数据，打开关闭文件等。
2013-07-07 11:10:01
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本文在研究SPWM控制技术的基础上，应用FPGA芯片EP1C12Q240C8实现了SPWM数字控制器，用于多模块逆变器并联控制系统。文中给出了仿真结果和芯片的测试结果。
2013-08-05 14:40:01
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该系统为后续的图像处理打下了坚实的基础，同时整个系统的逻辑模块资源消耗只占FPGA(EP1C12)的百分之几，剩余资源还可以来用作一些硬件算法。
2013-07-02 18:20:01
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本文在研究SPWM控制技术的基础上，应用FPGA芯片EP1C12Q240C8实现了SPWM数字控制器，用于多模块逆变器并联控制系统。文中给出了仿真结果和芯片的测试结果。
2013-08-05 16:10:01
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FPGA作为整个系统的核心器件，不仅要模拟出12C总线协议，完成视频解码芯片和编码芯片的初始化；还要对视频流同步信号提取，实现图像采集控制，并将图像信号存储在SRAM中；图像增强算法也是在FPGA中实现
2013-07-19 03:40:01
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高速输出通道及其在进步电视控制系统中的应用
第11章 8098单片机与CRT屏幕显示器的接口电路设计
第12
2013-11-19 22:48:01
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Functions for displays connected in 8 bit memory mapped mode －以8 位外部存储
器模式接口的LCD显示函数
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2013-10-22 03:56:01
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BDM 几乎是开发飞思卡尔8 位
（9S08 和RS08 系列）、16 位（9S12 系列）和32 位（Coldfire V1 系列）单片
机的标准调试模式，运用最为广泛；
2013-10-10 17:04:01
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1.1 XGATE Module in S12X
2013-10-15 17:48:01
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加速器的一般构成 11
1.6 加速器的主要指标 12
2013-11-21 17:28:02
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