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2 使用 QUARTUS II TEXT EDITOR .......................................... 8
2.2.3 使用 VERILOG HDL、VHDL
2015-10-08 18:09:06
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一方面是单片机的软件设计，它主要利用IAR Embeded Workbench开发环境，完成系统的界面显示及各种调幅参数的设置；另一方面是FPGA软件的设计，它主要利用Quartusll开发软件，采用VHDL
2022-06-18 19:40:02
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整个实验体系涵盖了数字逻辑电路验证和设计、FPGA设计流程和嵌入式软核PicoBlaze微控制器的应用；从基础的门逻辑的验证，EDA工具的使用；到加法器、逻辑运算器、移位器、简易ALU等复杂逻辑模块的设计以及硬件描述语言Verilog和VHDL
2023-06-10 04:20:03
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整个信号处理过程全部采用VHDL硬件描述语言来设计，并用Modelsim仿真系统功能进行调试，最后使用了Xilinx 公司可编程的FPGA芯片XC2S100完成，满足系统设计的要求。
2023-06-11 23:30:06
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论文中采用遗传算法自适应的确定非线性变换函数的参数对图像进行增强，在采用FPGA来实现的过程中先对系统进行模块划分，主要分为初始化模块、选择模块、适应度模块、控制模块等，然后利用VHDL语言描述各个功能模块
2023-09-25 20:10:01
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本设计以FPGA芯片CycloneⅡEP2C50U484C8为硬件平台，以QuartusⅡ为软件平台，利用VHDL硬件描述语言，实现了能够满足IEEE802.16e OFDMA系统中FFT变换点数分别为
2023-09-26 03:00:01
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在Xilinx ISE8.2i环境下，用VHDL硬件描述语言编写程序，实现(2，1，7)卷积码的Viterbi译码器。
2023-09-27 09:30:01
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智能控制器的设计原理和设计算法进行了深入的研究与分析；其次，利用MATLAB设计单神经元PID智能控制器，针对特定的被控对象，对其进行仿真实验，获得比较理想的系统输出；然后，研究基于FPGA的单神经元智能控制算法的实现，对控制器进行VHDL
2023-09-28 13:10:01
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基于FPGA技术实现整个频域抗干扰系统，在选择芯片上对VHDL代码进行编译综合、资源评估以及时序后仿真，验证程序代码的正确性。
2023-09-28 20:10:01
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在QuartusⅡ集成环境中进行FPGA的开发，使用VHDL语言和原理图输入法进行电路设计。
2023-10-01 02:40:01
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错误概率曲线；其次，利用DSPBuilder中的Signalcompiler将Chen-Mobius多路通信系统的主体模块(函数及积分器的产生等)转化成HDL硬件语言，后在QuartusⅡ软件平台上，结合利用VHDL
2023-10-02 18:50:01
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此外，根据FPGA的特点，在不改变外部硬件设计的前提下，改变相应的IP核或相关的VHDL程序就可对系统进行各种优化设计，以适应不同类型的GPS接收机的不同功能。
2023-10-03 05:00:02
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整个实验体系涵盖了数字逻辑电路验证和设计、FPGA设计流程和嵌入式软核PicoBlaze微控制器的应用；从基础的门逻辑的验证，EDA工具的使用；到加法器、逻辑运算器、移位器、简易ALU等复杂逻辑模块的设计以及硬件描述语言Verilog和VHDL
2023-10-04 03:50:01
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FPGA电路逻辑关系清晰，芯片时延小、速度快，且可用VHDL或Veilog HDL描述其内部逻辑电路，便于修改和升级。如果在高速数据采集系统中采用FPGA控制器，将极大地提高系统的稳定性和可靠性。
2023-10-04 14:10:01
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上述功能均采用VHDL描述，并在Xilinx(赛灵思)公司Spartan3E系列FPGA XC3S250E上实现，已经应用于视频展台的生产中。
2023-10-05 01:10:01
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整个信号处理过程全部采用VHDL硬件描述语言来设计，并用Modelsim仿真系统功能进行调试，最后使用了Xilinx 公司可编程的FPGA芯片XC2S100完成，满足系统设计的要求。
2023-10-05 05:30:01
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整个TTCM译码系统采用VHDL语言描述，在Quartus环境下逻辑综合。
2023-10-08 12:30:01
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FFTIP核采用现在ASIC领域的一种主流硬件描述语言VHDL进行编写，采用顺序的处理结构和IEEE浮点标准运算，具有系统简单、占用硬件资源少和高运算精度的优点。谐波分析仪系统组建采用SOPC系统。
2023-10-10 11:30:02
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所具有的静态可重复编程和动态在系统重构的特性,使得硬件的功能可以像软件一样通过编程来修改,这样就极大地提高了电子系统设计的灵活性和通用性,缩短了产品的上市时间并降低了电子系统的开发成本.基于此,本课题利用VHDL
2023-10-31 19:30:01
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整个TTCM译码系统采用VHDL语言描述，在Quartus环境下逻辑综合。
2024-01-05 01:10:01
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