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然后是调试和分析环境中使用代码处理箱（verisure/for verilog) (VHDLCover
/for VHDL)分析仿真结果，验证测试级别。
2013-04-24 16:38:36
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然后是调试和分析环境中使用代码处理箱（verisure/for verilog) (VHDLCover/for VHDL)分析仿真结果，验证测试级别。
2013-04-24 16:38:40
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-- the design makes use of the new shift operators available in the VHDL-93 std
-- this design passes
2015-07-02 00:50:01
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usart的verilog代码.rar
包括很多的FPGA ip 源码，可以直接应用
uart_vhdl.zip
sl811usb包含源程序.rar
mc8051_design.zip
mcpu
2016-01-28 00:34:02
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It
is designed to support both Verilog-HDL and VHDL.
2016-04-03 20:24:02
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原创代码，采用VHDL实现的64点均值滤波。实验测试过，效果良好。可轻松修改成任意点数均值滤波。采用了多点滑动运算，减小了输出延时，最大为3个时钟延迟。可用于AD采样后的滤波处理。
2014-01-24 10:43:02
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这个程序是基于等精度测频原理的频率计，用VHDL语言实现，频率测量测量范围1~9999；用4位带小数点数码管显示其频率，并且具有超量程、欠量程提示功能。
2014-01-23 01:41:14
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The most dominant
HDLs today are Verilog and VHDL.
2014-01-08 21:33:01
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这是可编程逻辑器件的参考资料，其中有详细的FPGA,VHDL等内容的讲解，及实验指导，下载绝不白下，非常有用。。。这是我当时学得觉得很受益，希望对你有些帮助
2014-08-17 11:30:31
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然后是调试和分析环境中使用代码处理箱（verisure/for verilog) (VHDLCover/for VHDL)分析仿真结果，验证测试级别。
2023-06-06 16:40:02
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然后是调试和分析环境中使用代码处理箱（verisure/for verilog) (VHDLCover
/for VHDL)分析仿真结果，验证测试级别。
2023-06-11 10:30:08
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本文主要阐述了利用VHDL 语言设计MIDI
2023-12-18 20:30:01
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本文使用实例描述了在 FPGA/CPLD 上使用 VHDL 进行分频器设计，包括偶数分频、非 50%占空比和 50%占空比的奇数分频、半整数（N+0.5）分频、小数分频、分数分频以及积分分频。
2025-04-01 10:00:01
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然后是调试和分析环境中使用代码处理箱（verisure/for verilog) (VHDLCover/for VHDL)分析仿真结果，验证测试级别。
2014-03-30 12:22:13
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实验1：Quartus入门
实验2：简单的组合逻辑电路设计
实验3：七段数码管显示
实验4：BCD码显示及运
实验5：触发器和计数器
实验6：存储器的设计
实验7：基于DE2 的SOPC系统开发附录
2016-04-20 00:28:01
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实验1：Quartus入门 实验2：简单的组合逻辑电路设计 实验3：七段数码管显示 实验4：BCD码显示及运 实验5：触发器和计数器 实验6：存储器的设计 实验7：基于DE2 的SOPC系统开发附录
2024-08-02 22:10:01
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介绍采用ALTERA 公司的可编程器件，实现I2C 总线的通信接口的基本原理； 给出部分VHDL语言描述。该通信接口与专用的接口芯片相比， 具有使用灵活， 系统配置方便的特点。
2013-05-20 14:00:01
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本实验教程选用Xilinx公司的产品X9572，与之配套的开发软件为ISE4.1i，可进行原理图的输入和VHDL硬件描述语言的输入，并且可利用Modelsim进行功能仿真和时序仿真。
2013-08-18 09:00:01
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研究了传统误码仪的工作原理与结构，并利用VHDL语言在FPGA芯片上模拟实现了绝大部分的传统误码仪的功能，如LCD显示驱动，串口通信驱动，误码测试，数据存储芯片驱动等功能.
2013-12-24 21:14:06
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本实验教程选用Xilinx公司的产品X9572，与之配套的开发软件为ISE4.1i，可进行原理图的输入和VHDL硬件描述语言的输入，并且可利用Modelsim进行功能仿真和时序仿真。
2016-09-05 10:47:02
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