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SunYuan ISO D-P-O-Q系列产品是顺源新开发的业界领先技术小体积（SIP12 Pin）低成本PWM脉冲调宽信号隔离变送器IC。
2022-11-18 02:30:02
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相对于单用户电表，多用户电表有多达32路以上通道，采用同一系统进行分时处理，该系统采用12位A／D转换芯片AD8364，能保证数据采集的精度和速度。上位机还能实现与银联系统联网，可远程控制用户的用电。
2023-06-10 03:30:06
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基于代码生成的车身网络电控系统设计
时间：2010-12-09 18:58:41 来源： 作者：叶青林 马忠梅 张幽彤
引言
在车身电子方面，国内外进行了系列的研究。
2024-01-18 23:50:01
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汽车ESP传感器及其接口技术详解
时间：2010-12-08 15:36:19 来源：中国汽车电子网 作者：
引言
ESP（Electronic Stability Program，电子稳定程序
2024-01-19 01:30:01
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KR30-3各轴分解图以及保养.pdf
9.KUKA机器人基本指令的使用.pdf
10.KUKA机器人外部自动配置方法.pdf
11.KUKA机器人控制屏操作3.pdf
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2020-06-28 21:12:36
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设计基于Xilinx的Virtex- II系列的FPGA的硬件平台,在ISE7.1中编译综合，最后通过Modelsim仿真验证。分辨率为352×288大小的源图像，在不同的压缩等级设置下，均测试通过。
2013-04-24 16:38:23
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在系统的开发过程中，使用了多种硬件、软件开发工具，如PROTEL DXP、ISE、MODEL SIM、MATLAB、C＃．NET等。
2013-07-19 08:00:01
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本文针对南京航空航天大学自行研制的微小卫星通信分系统的技术要求，在用SystemView和C语言仿真的基础上，用硬件描述语言Verilog设计了RS（255，223）编码器和译码器，使用Modelsim软件进行了功能仿真，并通过Xilinx公司的软件ISE
2013-08-01 13:30:01
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最后，运用VHDL语言在ISE10.1环境下完成了LDPC码基于二阶编码算法的编码器和基于最小和算法的译码器的FPGA设计。 @@ (3)论文通过对译码器结构的改进提高了译码器的性能和效率。
2023-09-26 15:50:01
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@@ 此外，由于FPGA实现了整个信息采集系统的接口和时序控制的功能，所以本文详细论述了用Verilog HDL语言在FPGA内实现数据采集时序控制、数据通讯等功能，并在ISE9.1开发环境下进行了Modelsim
2023-09-28 03:10:01
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在Xilinx ISE中分别实现旁路FIFO和Aurora模块的功能及时序仿真；最后在EDK中实现整体设计，下载到开发板上，并利用ChipScope Pro在线逻辑分析仪对设计进行验证，比较仿真结果满足预先的期望
2023-09-30 07:40:01
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并优化算法复杂度较大的功能模块，如小波变换模块，其优化方法包括：使用移位加代替乘法和除法运算，采用流水线设计提高时钟频率，引入行列变换并行结构提高并行度，使用双端口内存模块增加数据读写速度； (3)在ISE
2023-10-02 21:10:01
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在Xilinx ISE中分别实现旁路FIFO和Aurora模块的功能及时序仿真；最后在EDK中实现整体设计，下载到开发板上，并利用ChipSeope Pro虚拟逻辑分析仪对设计进行验证。
2023-10-03 04:40:01
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设计基于Xilinx的Virtex- II系列的FPGA的硬件平台,在ISE7.1中编译综合，最后通过Modelsim仿真验证。分辨率为352×288大小的源图像，在不同的压缩等级设置下，均测试通过。
2023-10-04 21:00:01
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在系统的开发过程中，使用了多种硬件、软件开发工具，如PROTEL DXP、ISE、MODEL SIM、MATLAB、C＃．NET等。
2023-10-05 05:10:01
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设计从指令的功能入手,采用部分译码的方法来实现各条指令所发出的控制信号.整个设计采用自顶向下的设计方法,用VHDL语言对设计实体的功能进行行为级描述,简练地设计了内部数据流图.用Xilinx公司的FPGA开发软件ISE4
2024-01-25 21:50:01
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并优化算法复杂度较大的功能模块，如小波变换模块，其优化方法包括：使用移位加代替乘法和除法运算，采用流水线设计提高时钟频率，引入行列变换并行结构提高并行度，使用双端口内存模块增加数据读写速度； (3)在ISE
2024-01-31 21:10:01
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在系统的开发过程中，使用了多种硬件、软件开发工具，如PROTEL DXP、ISE、MODEL SIM、MATLAB、C＃．NET等。
2024-03-08 12:50:02
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本文针对南京航空航天大学自行研制的微小卫星通信分系统的技术要求，在用SystemView和C语言仿真的基础上，用硬件描述语言Verilog设计了RS（255，223）编码器和译码器，使用Modelsim软件进行了功能仿真，并通过Xilinx公司的软件ISE
2024-03-13 15:00:01
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在Xilinx ISE中分别实现旁路FIFO和Aurora模块的功能及时序仿真；最后在EDK中实现整体设计，下载到开发板上，并利用ChipSeope Pro虚拟逻辑分析仪对设计进行验证。
2024-03-18 17:20:01
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