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2015-11-29 00:12:01
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用quartusII编写的，基于vhdl语言的按键加法器，从0到11，也可通过拨码开关控制，从11到0，加入了键盘防手抖。
2014-01-07 23:06:10
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用quartusII编写的，基于vhdl语言的按键加法器，从0到11，也可通过拨码开关控制，从11到0，加入了键盘防手抖。-
2013-12-23 18:26:21
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用quartusII编写的，基于vhdl语言的按键加法器，从0到11，也可通过拨码开关控制，从11到0，加入了键盘防手抖。
2016-01-03 20:24:01
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利用等精度测量原理，通过FPGA运用VHDL编程设计一个数字式频率计 设计具有较高的实用性和可靠性
2016-03-13 10:22:01
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PS2接口键盘扫描码截取电路，VHDL程序。该程序能够捕获PS2键盘按下的按键值，并将其扫描码转换成ASCII码。
2016-03-20 10:16:01
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数字钟代码，用VHDL语言设计一个数字钟系统，该系统具有显示时、分、秒的功能，具有较时功能，具有整点报时功能。
2016-08-18 00:39:02
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系统使用EDA技术设计了交通灯控制器，采用硬件描述语言VHDL按模块化方式进行设计，然后进行编程，时序仿真等。
2017-08-10 20:48:02
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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->Verilog 语言综合实践入门 Verilog HDL Synthesis
2023-05-10 07:50:04
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《CPLD_FPGA的数字通信系统建模与设计》，运用VHDL语言详细介绍了数字通信系统的建模与设计，如HDB3码的编写
2024-01-22 16:00:02
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适用于数字电路课程设计，使用VHDL语言实现全加器逻辑功能，帮助学生理解组合逻辑电路设计原理与实现方法。
2026-01-28 09:14:04
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2022-09-09 19:00:02
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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->王金明：《Verilog HDL 程序设计教程》及配套源码.rar
2023-05-29 07:00:02
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本文介绍了用VHDL 语言在CPLD内部编程，实现对F
2024-05-01 04:20:01
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用VHDL写两个模块，16位模可变计数器+与DSP通信读写控制模块，经笔者实验可以进行读写操作与计数器计数值读取。
2025-05-15 15:10:01
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帮助开发者快速上手VHDL设计，通过实际项目掌握自动售货机的逻辑控制与硬件实现，提升数字电路设计能力，适合EDA入门学习。
2026-01-07 21:42:40
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涵盖ADC08831芯片驱动的完整FPGA实现，使用VHDL语言编写，提供从数据采集到信号处理的底层逻辑解析，适用于高速ADC接口开发与验证。
2026-01-31 09:17:41
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基于VHDL语言实现的四位全加器，采用同步逻辑设计，支持快速进位运算。结构清晰，符合IEEE标准，适用于数字电路教学与验证场景。
2026-01-31 14:44:41
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焦点是什么需要计算，而不是如何计算。
2015-04-29 10:14:01
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它允许网页制作人建立文本与图片相结合的复杂页面，这些页面可以被网上任何其他人浏览到，无论使用的是什么类型的电脑或浏览器。神奇吗?一点都不神奇,因为现在你看到的就是这种语言写的页面。
2014-08-30 21:45:19
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