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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->Verilog-Semantics.pdf
2024-12-04 18:00:02
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阳初ucosII ADS1.2程序带VGA显示，可以在SDRAM中运行
友情提示:SDRAM运行前在AXD中执行SDRAM初始化命令
setmem 0x53000000, 0x00000000,
2013-12-26 15:19:01
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阳初ucosII ADS1.2程序带VGA显示，可以在SDRAM中运行
友情提示:SDRAM运行前在AXD中执行SDRAM初始化命令
setmem 0x53000000, 0x00000000,
2017-05-24 10:20:01
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本文详细介绍了一种数字图像采集系统的设计方案，该系统采用Altera公司的FPGA芯片作为中央处理器，由视频采集模块、SDRAM控制模块、PCI接口模块等组成。
2023-10-02 18:10:01
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本文详细介绍了一种数字图像采集系统的设计方案，该系统采用Altera公司的FPGA芯片作为中央处理器，由视频采集模块、SDRAM控制模块、PCI接口模块等组成。
2024-04-12 19:40:01
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学习FPGA的课件，内容含有软件的介绍，Altera和Xilinx芯片的介绍，以及VHDL的编程风格。和一些实例讲解。
2013-10-15 09:20:01
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学习FPGA的课件，内容含有软件的介绍，Altera和Xilinx芯片的介绍，以及VHDL的编程风格。和一些实例讲解。
2013-11-10 04:28:01
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8bit采样sine波形发生器,一共两个文件，各自用VHDL和VERILOG编写，通信开发平台专用
2015-05-11 00:26:08
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此文件包括FIR滤波器的设计对EDA的介绍，以及用VHDL语言实现FIR滤波器的FPGA实现
2013-12-02 20:41:02
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用verilog语言编的正弦波发生器，可以用QuartusII来打开这个源码，也可以转换成VHDL语言
2014-11-27 09:47:02
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2级流水线，使用4元件实现的22位全加器的VHDL语言实现，适用于altera的FPGA
2016-01-27 10:43:02
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3级流水线，含4元件的22位全加器的VHDL语言实现，适用于altera系列的FPGA
2016-01-27 10:44:01
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这个工程是基于FPGA与Philips的D12 USbB 1.1的完整设计，包括VHDL驱动和主机应用程序及驱动
2016-06-05 00:45:02
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以FPGA技术为基础，以VHDL为语言，以QuartusII为工具，设计一个5层楼的电梯控制器
2014-01-09 12:40:02
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根据PCM编码特点，利用VHDL来设计出采编器；本设计为码率2Mbs，子长为8位，帧长100位。
2013-12-30 16:36:07
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LCD的控制程序，采用硬件描述语言VHDL编写，里面还有仿真结果，是不可多得的学习材料
2014-01-24 06:25:13
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秒信号发生器，供初学者了解vhdl的编程方法，程序非常简单。编程环境使用Max+Plus IIV10.12
2014-01-17 17:51:13
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采用VHDL硬件描述语言设计，包含加法器，乘法器等以及寄存器的详细设计思路和设计源码
2015-04-16 10:47:40
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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->Verilog 黄金参考指南.pdf
2023-04-18 05:40:03
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用DSP Builder实现函数信号发生器，与其它软件相比，它更简单明了，可以直接生成VHDL语言，不用编写。
2024-05-05 22:20:02
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