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4位二进制加法器，vhdl实现,外带译码器部分，清晰简洁，可读性好
2017-07-03 20:51:02
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一个时钟计数器，用VHDL语言编写，有24进制，60进制功能，能在实验平台上运行，
2013-12-29 05:03:01
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基于Quartus II的十进制加法计数器的项目设计，包含了项目文件和VHDL源代码
2014-01-24 12:55:01
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ppm是通信类系统比较重要的前段部件，本设计只给出vhdl的代码实现，并给出测试。
2013-12-29 21:49:01
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VHDL语言编程，实现数字逻辑电路点阵风扇，北京邮电大学数字逻辑电路实验
2016-05-21 11:25:59
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Verilog／Vhdl转换的XHDL软件X-HDL执行智能翻译你的HDL代码,而不只是语法转换。
2023-04-16 19:30:02
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七人表决器，使用简洁的VHDL语言实现了七人表决器的功能
2024-01-19 15:40:01
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用VHDL控制8x8点阵LED的显示2汉字等跟中不同的实现效果
2025-04-07 13:30:01
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压缩包里存放是用VHDL编写的七段译码电路的源程序，运行环境是quartusII
2025-04-16 06:20:01
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含有万年历的数字钟，在Quarturs环境下开发，有各个模块的VHDL代码。
2025-05-14 13:10:01
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介绍FPGA中实现高精度快速除法运算的实现方法，给出实现高精度除法运算的VHDL源程序
2025-06-13 09:00:02
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学了模电数电基本知识后，这些知识在实际硬件产品设计中是如何应用，实际硬件产品电路又是什么样的呢？
2022-11-10 14:30:02
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CPU:S3C44B0X FLASH:HY29LV160BT 2M SDRAM:HY57V641620 8M 2 COM USB1.1 PDIUSBD12 NET RTL8019AS JTAG 14PIN
2013-07-19 10:20:01
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CPU:S3C44B0X FLASH:HY29LV160BT 2M SDRAM:HY57V641620 8M 2 COM USB1.1 PDIUSBD12 NET RTL8019AS JTAG 14PIN
2023-09-17 03:20:01
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是关于对数据采集卡的基于PC104总线的读写程序，开发环境Quarters , 用VHDL语言编写。
2013-08-29 16:00:06
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ALTERA NIOS处理器，VHDL语言在QUARTUS编译通过，然后有C语言在NIOS SHELL下驱动，实验音频解码
2015-04-13 20:22:02
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通俗的介绍了ise的使用方法，对vhdl和verilog开发的初学者来说是不错的选择
2015-04-16 00:05:01
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开发硬件的朋友们注意了，这是最新的VHDL编程书籍。里面有大量实用技巧及程序。
2014-01-04 09:58:02
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16位计数器的设计，这里是实现上述功能的VHDL源程序，供大家学习和讨论。
2013-12-20 02:49:20
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里面有许多库函数，对于ｖｌｏｇ或ｖｈｄｌ编程有很多好的源代码可以剪切！
2015-06-01 20:47:01
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