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在软件设计方面，系统采用嵌入式实时操作系统μC/OS-II，便于系统升级和维护。在系统硬件平台的基础上，根据设计要求对操作系统内核进行剪裁和移植，并对系统时钟节拍进行修改。
2023-06-19 21:00:05
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基于双NIOS II 的IP无线收发机 2006年嵌入式电子大赛获奖作品.
2015-04-24 09:50:56
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在这个草根时代，写本书也不
是什么大不了的事情。
在确认了写书的目标后，匠人就这本书的内容和文风进行了思考。匠人究竟应该写一本怎样的书？作为作者的匠人，和作为读者的您，我们究竟需要什么？
2022-06-23 19:50:02
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35. ucos-ii的图形界面移植.
36. 很好的一个菜单处理程序.
37.
2015-04-24 09:50:56
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基于STM32F103VET6的智能手表，开放源代码，电路原理图，系统采用STM32F103VET6（主控芯片）+uCOS（操作系统）-III+emwin5.24(图形界面)+MPU6050（三轴加速度传感器
2022-03-19 08:30:01
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对系统划分模块以及各个模块的信号连接；然后进行模块设计，设计出每个模块的功能，并用VHDL语言编写代码来实现模块功能；再使用ISE8.2I自带的仿真器对各模块进行功能仿真和时序仿真；最后进行硬件验证，在Virtex-II
2013-07-13 13:40:01
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在硬件设计方面，介绍了主控制器模块的电源电路、串口电路、存储器电路、人机交互电路、与ZigBee通信模块的接口设计、与GPRS模块接口设计；在软件设计方面，提出了基于需时中断的软件设计方法，移植了μC/OS-II
2013-06-13 10:30:01
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最后对滞环控制算法进行了模块划分，将其划分为PI算法模块，限幅与指令电流生成模块，滞环比较模块，PWM脉冲生成及死区保护模块，AD控制及数据储存模块，并在Quartus II软件环境下，使用VHDL语言通过编程实现模块化设计
2013-04-24 16:38:35
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对系统划分模块以及各个模块的信号连接；然后进行模块设计，设计出每个模块的功能，并用VHDL语言编写代码来实现模块功能；再使用ISE8.2I自带的仿真器对各模块进行功能仿真和时序仿真；最后进行硬件验证，在Virtex-II
2013-04-24 16:38:35
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同时将
HC/OS-II作为系统软件。完成了系统的主要任务的设计。
2022-08-17 15:30:01
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最后对滞环控制算法进行了模块划分，将其划分为PI算法模块，限幅与指令电流生成模块，滞环比较模块，PWM脉冲生成及死区保护模块，AD控制及数据储存模块，并在Quartus II软件环境下，使用VHDL语言通过编程实现模块化设计
2023-06-12 22:10:21
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软件系统以μC/OS–II嵌入式实时操作系统为核心，开发系统所需的底层设备驱动程序和应用程序接口（API）函数。
2023-06-14 02:30:53
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在硬件设计方面，介绍了主控制器模块的电源电路、串口电路、存储器电路、人机交互电路、与ZigBee通信模块的接口设计、与GPRS模块接口设计；在软件设计方面，提出了基于需时中断的软件设计方法，移植了μC/OS-II
2023-06-14 09:30:18
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本论文是兰州铁路局迎水桥机务段“电力机车能耗管理系统”项目中DDSDJ-II型电力机车智能电度表的进一步扩展和实现产业化。论文首先综述了传统机械式电表的技术现状和管理现状以及其存在的一些问题。
2023-09-15 15:10:01
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在Quartus II环境下，采用模块化设计思想，借助Verilog语言及调用FPGA内部IP核完成了系统逻辑设计，包括：12C配置模块、有效数据提取模块、灰度分量提取模块、帧缓存模块、图像算法处理模块
2023-09-26 10:20:02
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本系统采用Xilinx公司的Virtex-II Pro FPGA作为温度采集控制器平台，作为连接上位机与传感器网络的核心部分。传感器网络由达拉斯半导体公司的单总线数字温度传感器DS18820组成。
2023-09-28 13:30:01
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最后对滞环控制算法进行了模块划分，将其划分为PI算法模块，限幅与指令电流生成模块，滞环比较模块，PWM脉冲生成及死区保护模块，AD控制及数据储存模块，并在Quartus II软件环境下，使用VHDL语言通过编程实现模块化设计
2023-10-02 09:00:01
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对系统划分模块以及各个模块的信号连接；然后进行模块设计，设计出每个模块的功能，并用VHDL语言编写代码来实现模块功能；再使用ISE8.2I自带的仿真器对各模块进行功能仿真和时序仿真；最后进行硬件验证，在Virtex-II
2023-10-02 15:40:02
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本系统选用Xilinx公司的Virtex-II系列FPGA器件实现功能设计，选用Micron公司SDRAM作为外部存储器件。
2023-10-12 13:00:02
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对系统划分模块以及各个模块的信号连接；然后进行模块设计，设计出每个模块的功能，并用VHDL语言编写代码来实现模块功能；再使用ISE8.2I自带的仿真器对各模块进行功能仿真和时序仿真；最后进行硬件验证，在Virtex-II
2024-03-03 22:50:01
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