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EasyARM2200(Philips LPC2210为处理器、ARM7为内核)嵌入式网络控制系统的研究，实现了总体网络拓扑结构的设计和智能馈电开关控制系统硬件电路的设计；通过对嵌入式实时操作系统的移植、嵌入式TCP/IP
2013-06-25 17:40:01
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随着SOC技术、IP技术以及集成电路技术的发展，RISC软核处理器的研究与开发设计开始受到了人们的重视。
2013-07-21 13:20:01
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如果能通过“过采样”方法在普通的逻辑电路上实现622.08Mb/s甚至更高速率的数据恢复,并将它作为一个IP模块来代替专用的时钟恢复芯片,这无疑将是性能和成本的较好结合。
2013-04-24 16:38:35
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视频压缩采用LZW无损压缩算法，用Verilog语言设计了压缩模块和解压缩模块，利用Xilinx公司的IP核生成工具Core Generator生成FIFO来缓存压缩/解压缩单元的输入输出数据，光纤线路码采用
2013-04-24 16:38:37
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采用FPGA来实现，可以充分利用现有的IP核，功能扩展容易，设计开发成本低，上市时间快，修改方便，甚至可以远程重构系统。与单片机相比，集成度高，可靠性好，调试和维护方便。
2013-08-05 03:50:01
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sfr IE = 0xA8;
sfr P3 = 0xB0;
sfr IP
2014-01-05 19:29:09
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简单叙述了有源电力滤液器常用的语波检测方法，比较其各白的优劣，其中着重突出本文所用到的基于瞬时无功功率的改进的ip-i法。
2022-06-22 14:30:01
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介绍了应用VHDL语言和嵌入式微控制器IP核的软件编程。并对FPGA控制偏振控制器的方案及实验进行了详细分析。
2023-06-06 10:40:02
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采用FPGA来实现，可以充分利用现有的IP核，功能扩展容易，设计开发成本低，上市时间快，修改方便，甚至可以远程重构系统。与单片机相比，集成度高，可靠性好，调试和维护方便。
2023-06-10 05:10:03
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视频压缩采用LZW无损压缩算法，用Verilog语言设计了压缩模块和解压缩模块，利用Xilinx公司的IP核生成工具Core Generator生成FIFO来缓存压缩/解压缩单元的输入输出数据，光纤线路码采用
2023-06-10 12:20:04
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使用Verilog语言设计了FM24读写IP软核，实现外部存储器的高速读写，经过功能验证后集成入本系统中。
2023-06-12 17:20:12
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随着SOC技术、IP技术以及集成电路技术的发展，RISC软核处理器的研究与开发设计开始受到了人们的重视。
2023-06-13 16:40:05
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EP20K100BC356-1V芯片作为目标器件进行了综合和后仿真,并且将仿真结果通过MATLAB与理论参数进行了比较,结果表明设计是正确的.对设计中存在的误差和部分模块的进一步优化,该文也作了分析和说明,为下一步实现通用IP
2023-06-15 02:50:06
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同时，在设计中成功地调用了Xilinx公司的IP核，实现了设计复用。
2023-06-15 05:00:23
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终端通过以太网接入到INTERNET，利用TCP/IP协议进行传输，实现生理参数信号的远程采集与传输。在医疗端给出针对不同终端客户的医疗建档和服务。
2023-06-19 18:00:03
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最后详细分析了嵌入式视频服务器软件部分各个功能模块的设计思路及其关键代码实现，用Liflux vide04linux APIs实现了视频图像的采集，视频数据网络传输采用了基于UDP协议的IP组播方式，而视频图像显示模块则采用了自行设计实现的基于
2023-06-19 20:00:03
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同时，在设计中成功地调用了Xilinx公司的IP核，实现了设计复用。
2023-06-24 05:50:03
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视频压缩采用LZW无损压缩算法，用Verilog语言设计了压缩模块和解压缩模块，利用Xilinx公司的IP核生成工具Core Generator生成FIFO来缓存压缩/解压缩单元的输入输出数据，光纤线路码采用
2023-06-27 00:40:02
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LabVIEW是一种图形化的编程语言(G语言)，整合了诸如GPIB、VXI、PXI、RS-232和RS-485以及数据采集卡等硬件通信的全部功能，还内置了便于应用的TCP/IP、ActiveX的软件标准的库函数
2023-06-29 20:00:02
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在基于瞬时无功功率理论的ip—iqSTATCOM参考电流检测方法基础上，针对不平衡系统(尤其是电网本身不平衡)情况下的谐波电流检测和无功补偿，提出一种以电网三相基波正序电压为同步参考坐标的改进型电流检测方法
2023-09-12 16:00:01
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