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ram的硬件描述 使用VHDL语言 注释也十分详细 想要的赶紧下载吧

ram的硬件描述 使用VHDL语言 注释也十分详细 想要的赶紧下载吧
2013-12-24 16:30:01 下载 23 查看 1,125
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电机转速控制器的硬件描述 使用VHDL语言 注释详细 想要的赶紧下载吧

电机转速控制器的硬件描述 使用VHDL语言 注释详细 想要的赶紧下载吧
2014-07-19 20:59:02 下载 123 查看 1,094
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十种状态机例子(VHDL)包括米勒型和莫尔型的状态机。

十种状态机例子(VHDL)包括米勒型和莫尔型的状态机。
2013-12-31 12:17:01 下载 154 查看 1,103
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基于VHDL语言关于VGA的简单应用。对于快速理解如何使用VGA有很大的帮助

基于VHDL语言关于VGA的简单应用。对于快速理解如何使用VGA有很大的帮助
2013-12-11 22:57:03 下载 36 查看 1,094
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是关于vhdl的学习ppt。希望对想学习eda的有点帮助。感觉挺不错的。

是关于vhdl的学习ppt。希望对想学习eda的有点帮助。感觉挺不错的。
2014-01-02 05:32:11 下载 159 查看 1,146
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VHDL source codes of the FPGA64, a fpga implementation of the C64 computer. Version for the c-one fp

VHDL source codes of the FPGA64, a fpga implementation of the C64 computer.
2017-09-24 20:29:02 下载 137 查看 1,144
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VHDL硬件描述语言与数字逻辑电路设计 333页 18.9M.pdf

可编程逻辑器件相关专辑 96册 1.77G
VHDL硬件描述语言与数字逻辑电路设计 333页 18.9M.pdf
2014-05-05 18:57:24 下载 82 查看 4,021
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基于FPGA的交通灯控制器设计(VHDl代码全-各个模块均调试通过)

基于FPGA的交通灯控制器设计(VHDl代码全-各个模块均调试通过)


这是一份非常不错的资料,欢迎下载,希望对您有帮助!


2021-12-27 10:00:01 下载 10 查看 5,704
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VHDL 语言设计数字钟,实现在数码管上显示分钟和秒

VHDL 语言设计数字钟,实现在数码管上显示分钟和秒,并且可以手动调节分钟, 实现分钟的增或者减。
2022-12-03 05:00:02 下载 1 查看 6,428
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VHDL硬件描述语言与数字逻辑电路设计 333页 18.9M.pdf

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL硬件描述语言与数字逻辑电路设计 333页 18.9M.pdf
2023-05-03 09:10:05 下载 5 查看 9,186
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VHDL硬件描述语言与数字逻辑电路设计-333页-18.9M.pdf

专辑类-可编程逻辑器件相关专辑-96册-1.77G VHDL硬件描述语言与数字逻辑电路设计-333页-18.9M.pdf
2023-07-08 19:10:08 下载 9 查看 9,713
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VHDL硬件描述语言与数字逻辑电路设计-333页-18.9M.rar

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2023-07-15 04:20:03 下载 10 查看 6,306
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Quartus 2版本5.0 Nios2 IDE版本5.0 硬件平台自己根据软件构建

Quartus 2版本5.0 Nios2 IDE版本5.0 硬件平台自己根据软件构建
2016-06-23 20:33:01 下载 102 查看 1,100
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使用Quartus II设计并制作一台出租车计价器不同情况具有不同的收费标准行驶公里: 在行车三千米以内时

使用Quartus II设计并制作一台出租车计价器不同情况具有不同的收费标准行驶公里: 在行车三千米以内时,按起步价10元收费,超过3千米部分,以每千米1.6元计算。
2013-12-11 02:43:01 下载 181 查看 1,144
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ALTERA NIOS处理器实验

ALTERA NIOS处理器实验,QUARTUS下用VHDL编译成处理器,然后NIOS SHELL下C 语言运行。实验SRAM和DMA调度
2015-04-13 20:21:02 下载 104 查看 1,040
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并入串出移位寄存器和8路并行输出串行移位寄存器的VHDL代码

并入串出移位寄存器和8路并行输出串行移位寄存器的VHDL代码,经Quartus II 5.1验证可用
2013-12-26 04:10:13 下载 38 查看 1,437
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第1 章 体系结构 第1 问: Q:请问在初始化CPU 堆栈的时候一开始在执行mov r0, LR 这句指令时处理器是什么模式 A:复位后的模式,即管理模式.

第1 章 体系结构 第1 问: Q:请问在初始化CPU 堆栈的时候一开始在执行mov r0, LR 这句指令时处理器是什么模式 A:复位后的模式,即管理模式.
2013-12-30 01:13:01 下载 79 查看 1,089
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内有两篇关于fpga设计的文章:Quartus II中上拉电阻的设置方法、QuartusII中Tsu_Tco约束方法。对fpga设计工程师会有用

内有两篇关于fpga设计的文章:Quartus II中上拉电阻的设置方法、QuartusII中Tsu_Tco约束方法。对fpga设计工程师会有用
2015-11-20 10:13:02 下载 122 查看 1,134
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ds18b20的介绍及时序

ds18b20的介绍及时序,以及对ds18b20进行温度读写的vhdl程序,在quartus环境下进行编译仿真
2017-07-20 10:51:02 下载 150 查看 1,041
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基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计

基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计,并在EDA(电子设计自动化) 工具的帮助下,用大规模可编程逻辑器件(FPGA/ CPLD) 实现数字频率计的设计原理及相关程序
2013-08-06 09:00:01 下载 133 查看 1,174
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