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1、SDH概述——建立SDH基本概念
SDH是什么？
为什么会产生SDH体制？
SDH体制的优缺点。
2025-01-01 00:10:01
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SPI serial flash ROM的verilog源代码, 针对winbond W25x16,已经经过逻辑验证,并实际用在芯片设计中,作为一个模块,正常工作.
2025-06-25 03:30:01
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书籍“无线通信fpga设计”里的源代码实例，里面有verilog和MATLAB两种语言实例
2013-08-07 18:30:01
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交通灯状态机的实现，用verilog HDL编程，Xilinx ISE 6仿真，在实际电路中得到验证．
2015-07-25 10:43:01
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本软件在CPLD上实现数字PWM控制，用Verilog HDL语言编写，在MAX ＰＬＵＳ ＩＩ调试成功，可用
2015-08-04 10:12:01
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我收藏的一些小技巧，适合刚开始学习verilog的朋友，养成好的编写习惯很重要哦~
2014-01-02 17:45:08
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Circular_Buffer，流水线型多位缓存器，verilog语言描述。通过modelsim 6。0仿真，quartus 综合通过。
2014-01-25 04:26:01
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通信系统中的加扰与解扰程序，用verilog语言实现，有波形文件可以直接查看功能
2016-04-04 20:49:01
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一组两个电梯的控制器，希望对初学Verilog硬件描述语言的人有帮助。
2013-12-23 01:31:20
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介绍了代码的可执行性，介绍了实现的过程，介绍了verilog程序。
2016-05-01 10:29:02
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Altera公司的CORDIC开发包，用Verilog编写的，安装在Quartus相同目录中，里面有详细的开发说明。
2016-06-25 20:50:10
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用于FPGA的变长编码算法的HDL编码，包括VHDL及Verilog代码。可用于JPEG及MPEG压缩算法。
2013-12-06 11:47:01
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8位加法树乘法器,实现两个8位二进制数相乘，采用verilog hdl
2016-12-19 00:31:01
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FIFO先进先出队列，一种缓存、或一种管道、设备、接口（Verilog HDL程序,内附说明）
2014-01-22 23:05:14
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书籍“无线通信fpga设计”里的源代码实例，里面有verilog和MATLAB两种语言实例
2013-12-14 17:09:03
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用verilog写的can总线代码，包括ram读写等操作，需要对can总线有一定的了解。
2019-10-10 09:43:59
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用verilog编写的网卡芯片rtl级。前仿后仿都通过了，可以在modelsim上运行察看
2019-12-06 10:07:48
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基于altera 的cyclone 做的频率计源码，使用的是verilog进行编写，eda工具是quartus ii 12.0
2023-03-02 19:00:04
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Verilog／Vhdl转换的XHDL软件X-HDL执行智能翻译你的HDL代码,而不只是语法转换。
2023-04-16 19:30:02
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结合EDA技术与VERILOG HDL开发环境总结的实验报告，在multism下仿真运行的到仿真图
2023-10-11 16:00:01
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