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利用拨码开关为可编程器件输入读写命令和相应的地址、数据

(Verilog+单片机)
2014-01-10 02:59:01 下载 167 查看 1,084
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Cadence 使用手册

本手册共分为三部分:第一部分分为四章,分别介绍 Cadence cdsSpice、virtuoso Editing、Diva 和 verilog。第二部分主要介绍 MEDICI。

2022-10-08 06:20:02 下载 9 查看 1,102
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一种用于浮点DSP的流水线结构DMA设计

· 摘要:  本文提出了一种用于32位浮点DSP处理器的改进型DMA结构.采用两级数据流水线结构,外设与内部存储器的数据传输速率比原来提高了一倍.使用verilog HDL语言对其进行编码和仿真
2024-06-03 10:20:02 下载 10 查看 8,477
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交通灯程序

在嵌入式系统和数字电路设计项目中,这款Verilog编写的交通灯程序是不可或缺的一部分。它通过模拟真实世界的交通信号控制逻辑,帮助开发者理解和实现复杂的时序控制。
2025-12-18 14:32:11 下载 2 查看 94
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十进制可逆计数器

在Quartus II开发环境中,使用Verilog语言和层次文件输入法设计的十进制可逆计数器。该资料详细介绍了如何实现一个灵活且功能强大的计数器,适用于各种数字系统设计项目。
2025-12-21 17:22:01 下载 3 查看 15
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深入了解数字示波器死区时间及其影响

不 同厂商的MSO 之间的差别是什么?
2013-04-24 16:38:34 下载 166 查看 1,094
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深入了解数字示波器死区时间及其影响

不 同厂商的MSO 之间的差别是什么?
2023-06-14 19:20:11 下载 5 查看 6,360
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基于FPGA和PCI总线的WCDMA信号采集卡的研制

  本论文利用FPGA可编程逻辑器件和硬件描述语言Verilog,采用自顶向下的设计方法,开发了一款基于PCI总线的高速数据采集卡。
2013-04-24 16:38:33 下载 147 查看 1,104
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QUICKLOGIC QUICKWORKS 9.8.4

同时,QuickWorks 9.8还包括的新的功能有:集成Precision Synthesis 综合工具:VHDL和Verilog综合可对QuickLogic器件进行优化,为RTL和FPGA设计提供内置的电路图观察功能
2023-04-16 18:10:03 下载 6 查看 3,900
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基于FPGA和PCI总线的WCDMA信号采集卡的研制

  本论文利用FPGA可编程逻辑器件和硬件描述语言Verilog,采用自顶向下的设计方法,开发了一款基于PCI总线的高速数据采集卡。
2024-01-20 02:30:01 下载 1 查看 4,488
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VIP专区-嵌入式/单片机编程源码精选合集系列(16)


6. verilog浮点乘发器.
7. verilog浮点乘发器.
8. verilog浮点乘发器.
9. verilog浮点乘发器.
2015-04-24 09:50:55 下载 10 查看 7,021
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基于FPGA的QAM调制解调技术研究.rar

最后编写Verilog代码实现了算法仿真。 FPGA芯片采用的是Altera公司的大规模集成电路芯片Cyclone系列的EPlC20F32417,并通过软件编程对其进行了相关调试。
2013-04-24 16:38:23 下载 153 查看 1,172
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基于FPGA的QAM调制解调技术研究

最后编写Verilog代码实现了算法仿真。 FPGA芯片采用的是Altera公司的大规模集成电路芯片Cyclone系列的EPlC20F32417,并通过软件编程对其进行了相关调试。
2013-06-12 03:30:01 下载 32 查看 1,138
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基于FPGA的QAM调制解调技术研究

最后编写Verilog代码实现了算法仿真。 FPGA芯片采用的是Altera公司的大规模集成电路芯片Cyclone系列的EPlC20F32417,并通过软件编程对其进行了相关调试。
2023-06-12 15:30:19 下载 6 查看 3,388
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基于FPGA的QAM调制解调技术研究.rar

最后编写Verilog代码实现了算法仿真。 FPGA芯片采用的是Altera公司的大规模集成电路芯片Cyclone系列的EPlC20F32417,并通过软件编程对其进行了相关调试。
2023-10-08 08:30:01 下载 7 查看 9,904
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AVS运动补偿电路的VLSI设计与实现 提出了一种基于AVS标准的高效的运动补偿电路硬件结构

采用Verilog语言完成了VLSI设计,并通过EDA软件给出仿真和综合结果。
2013-11-27 23:08:02 下载 173 查看 1,074
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设计一个能进行时、分、秒计时的十二小时制或二十四小时制的数字钟

Verilog HDL语言实现
2017-01-30 10:33:01 下载 38 查看 2,092
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高性能FPGA的典型应用领域

目前以硬件描述语言(Verilog 或 VHDL)所完成的电路设计,可以经过简单的综合与布局,快速的烧录至 FPGA 上进行测试,是现代 IC 设计验证的技术主流。
2024-09-06 11:30:01 下载 9 查看 4,852
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FPGA那些事儿--TimeQuest静态时序分析REV7.0

写《工具篇

I》不像写《Verilog HDL 那些事儿》系列的笔记一样,只要针对原理和HDL 内容作出

解释即可,虽然《Verilog HDL 那些事儿》夹杂着许多笔者对Verilog

2022-05-02 22:00:01 下载 11 查看 4,701
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Protel采用数据库的管理方式

Protel 99SE容易使用的特性还体现在“这是什么”帮助,按下右上角的小问号,然后输入你所要的信息,可以很快地看到特性的功能,然后用到设计中,按下状态   栏末端的按钮,使用自然语言帮助顾问
2013-12-23 07:56:02 下载 36 查看 1,091
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