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基于Verilog的关于频率计的编程代码，相关都已设定好，可以直接打开在ISE软件上运行。
2025-12-31 17:38:54
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详细阐述一种利用CPLD 实现的8 位单片机与PCI 设备间的通信接口方案，给出用ABEL HDL编写的主要源程序。该方案在实践中检验通过。
2013-10-30 12:32:02
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如何让Allegro 与Concept-HDL 实现反向标注
2022-12-09 18:20:02
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详细阐述一种利用CPLD 实现的8 位单片机与PCI 设备间的通信接口方案，给出用ABEL HDL编写的主要源程序。该方案在实践中检验通过。
2024-02-19 21:40:01
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通俗的介绍了ise的使用方法，对vhdl和verilog开发的初学者来说是不错的选择
2015-04-16 00:05:01
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dds设计，花了一个星期做的,verilog写的，可生成多种波形，频率范围可上M,性能不错。
2013-11-29 02:37:01
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在quaters下写的比较数的大小输出，verilog语言写的，具有状态机和存储器
2015-12-02 00:57:01
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这是一篇关于8位RISC CPU设计的文章，其中包含了用Verilog语言编写的CPU内核程序
2013-12-22 14:25:08
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i2c slave,这个是I2CBUS接收端的源代码，由VERILOG写成，经过综合和调试
2016-03-14 20:05:01
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用LSFR实现计数功能，可以减少对寄存器和少一个加法器，涉及verilog的人来说
2017-01-05 00:37:01
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用Verilog语言编写的PCI通信协议代码，经过工程测试，程序完全能够顺利识别出PCI板卡！
2016-05-27 08:46:33
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VERILOG 和 VHDL相互转化的工具，经过验证，确实好用，传上来大家共享，如果感觉好就下载吧
2023-02-16 15:40:02
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Xilinx 的Verilog 综合仿真工具，安装简便，烧录过程快速，用板子进行实际操作的学习者必备。
2023-03-01 07:30:02
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详细描写数字信号处理中的FIR、IIR数字滤波器、FFT变化的verilog语言代码实现。
2025-06-03 00:00:01
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MAX+PLUS II Advanced Synthsis ALtera的一个免费HDL综合工具，安装后可以直接使用，是MaxplusII的一个插件，用这个插件进行语言综合，比直接使用MaxplusII
2013-05-27 23:20:01
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This implementation demonstrates that results similar to hand-coded HDL can be achieved
using the C
2014-01-16 19:21:01
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MAX+PLUS II Advanced Synthsis ALtera的一个免费HDL综合工具，安装后可以直接使用，是MaxplusII的一个插件，用这个插件进行语言综合，比直接使用MaxplusII
2024-05-07 02:30:01
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适用于FPGA开发流程中的设计验证与综合阶段，提供从HDL代码到可编程逻辑的完整转换路径。支持主流厂商工具链，提升开发效率与设计可靠性。
2026-01-15 17:15:13
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MAX+PLUS II Advanced Synthsis ALtera的一个免费HDL综合工具，安装后可以直接使用，是MaxplusII的一个插件，用这个插件进行语言综合，比直接使用MaxplusII
2014-03-30 12:22:13
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公司的BCM1250的FIFO接口与PMC-Sierra公司的PM5351的POS-PHY Level2通信接口协议之间的无缝连接和速率适配.论文首先回顾了POS技术和NP技术的发展历程;然后系统介绍了Verilog
2024-01-27 19:40:01
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