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用Verilog语言编写的，对初学者会有一定的帮助。
2014-01-24 06:42:02
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源码中包括C代码和verilog源码。
2016-04-05 10:44:01
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这是CAN总线控制器的IP核，源码是由Verilog HDL编写的。其硬件结构与SJA1000类似，满足CAN2.0B协议。
2014-01-05 23:19:10
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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL语言100例详解 511页 7.4M.pdf
2023-05-20 00:20:03
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高效的状态机设计，很不错的书，有3个例子和一个pdf说明文档，学习verilog的朋友可以多看看
2023-10-23 05:20:02
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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL在高速图像采集系统中的应用设计.pdf
2024-07-20 02:00:01
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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->用VHDL 设计的步进电机脉冲分配器.pdf
2024-11-08 01:20:02
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帮助通信工程师快速掌握OFDM基带发信机的实现逻辑，通过Verilog代码深入理解调制与信号处理流程，提升系统设计能力。
2026-01-12 21:42:12
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基于Verilog语言的实践指南，融合FPGA开发核心流程与编程逻辑，深入解析硬件描述语言的实际应用，助力开发者快速掌握底层设计原理。
2026-01-23 14:37:16
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基于Verilog实现的VGA时序控制模块，采用同步设计方法确保信号稳定性。支持标准VGA分辨率，适用于FPGA开发与显示接口调试。
2026-02-02 17:07:08
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在软件开发领域一个非常流行的人月神话问题：在众多的软件开发项目中，缺乏合理的时间进度是造成项目滞后的最主要原因，它比其他所有因素加起来影响还大，导致这种普遍性灾难的原因是什么呢？
2013-12-11 13:14:02
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对 CAN 是什么、 CAN 的特征、标准规格下的位置分布等、CAN 的概要及 CAN 的协议进行了说明。
2019-01-09 10:32:45
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基于FPGA设计数字锁相环，提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案
2013-08-19 18:00:01
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一个带波形输出的扫频模板systemC源程序，
该程序在SystemCStudio开发平台下生成，
实现systemC仿真、波形显示以及自动生成Verilog HDL代码。
2014-11-22 09:35:52
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基于FPGA设计数字锁相环，提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案
2013-12-25 01:41:06
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假设饮料只有一种价格为2.5元，硬币有0.5元和1.0元两种，考虑找零，用Verilog描述其控制电路，并用FPGA实现
2014-01-11 18:25:01
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该模块是一个用verilog语言实现的I2C模块，完全开源，可以直接挂载在AVALON总线上，用QSYS开发非常实用简单。
2022-11-14 12:30:02
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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->2 VHDL语言的程序结构与数据类型.pdf
2024-10-25 12:50:01
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该流程只适用于 FPGA 的前仿真，使用 verilog 文件以及测
试文件
2025-05-15 14:40:01
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由两部分组成,"C"文件夹内,是用于在 51 单片机上运行的 C语言程序, "Verilog"文件夹内,是用Verilog语言编写的 FPGA 程序.
2014-12-06 00:07:01
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