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FIFO FPGA
异步FIFO是一种先进先出的电路，使用在需要产时数据接口的部分，用来存储、缓冲在两个异步时钟之间的数据传输。在异步电路中，由于时钟之间周期和相位完全独立，因而数据的丢失概率不为零。
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fifo堆栈
VHDL Test Bench created by HDL Bencher 1.02
-- Mon Feb 05 11:59:49 2001
LIBRARY ieee;
USE ieee.std_logic_1164.all;
USE ieee.std_logic_unsigned.all;
LIBRARY UNISIM;
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软FIFO在多DSP间通信中的应用
·摘要： 随着数字信息的发展,对数据处理能力的要求日益提高,越来越多地需要利用多个DSP协调工作.该文提出一种利用软FIFO实现多个DSP间的高速通信的方案,并进行了仿真试验.仿真结果表明该方案是可行有效的
