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用verilog编写的网卡芯片rtl级。前仿后仿都通过了，可以在modelsim上运行察看
2019-12-06 10:07:48
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基于altera 的cyclone 做的频率计源码，使用的是verilog进行编写，eda工具是quartus ii 12.0
2023-03-02 19:00:04
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Verilog／Vhdl转换的XHDL软件X-HDL执行智能翻译你的HDL代码,而不只是语法转换。
2023-04-16 19:30:02
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结合EDA技术与VERILOG HDL开发环境总结的实验报告，在multism下仿真运行的到仿真图
2023-10-11 16:00:01
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该代码是针对于verilog初学者对于图像编解码最简单的一个例程
2024-05-17 12:50:01
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直接将Verilog底层驱动，封装为IP即可在EDS里面调用；各个键值功能稳定，消除抖动需适当延时。
2025-03-24 20:10:01
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采用Verilog编写的FIR滤波器，采用并行结构。参数采用Matlab的FDAtool提取，希望对大家有用
2025-05-21 01:50:01
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基于Verilog的关于频率计的编程代码，相关都已设定好，可以直接打开在ISE软件上运行。
2025-12-31 17:38:54
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基于QUARTUSII软件 实现FPGA（ATERA CYCLONE II系列）与SD卡SD模式通信\r\n所用语言位verilog HDL
2013-08-20 18:00:01
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通俗的介绍了ise的使用方法，对vhdl和verilog开发的初学者来说是不错的选择
2015-04-16 00:05:01
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dds设计，花了一个星期做的,verilog写的，可生成多种波形，频率范围可上M,性能不错。
2013-11-29 02:37:01
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在quaters下写的比较数的大小输出，verilog语言写的，具有状态机和存储器
2015-12-02 00:57:01
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这是一篇关于8位RISC CPU设计的文章，其中包含了用Verilog语言编写的CPU内核程序
2013-12-22 14:25:08
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i2c slave,这个是I2CBUS接收端的源代码，由VERILOG写成，经过综合和调试
2016-03-14 20:05:01
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有两个，一个用VHDL编写的I2C，一个Verilog hdl语言编写的
2014-12-21 06:50:02
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用LSFR实现计数功能，可以减少对寄存器和少一个加法器，涉及verilog的人来说
2017-01-05 00:37:01
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用Verilog语言编写的PCI通信协议代码，经过工程测试，程序完全能够顺利识别出PCI板卡！
2016-05-27 08:46:33
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VERILOG 和 VHDL相互转化的工具，经过验证，确实好用，传上来大家共享，如果感觉好就下载吧
2023-02-16 15:40:02
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Xilinx 的Verilog 综合仿真工具，安装简便，烧录过程快速，用板子进行实际操作的学习者必备。
2023-03-01 07:30:02
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用Verilog hdl硬件描述语言编写。
2024-05-22 23:20:03
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