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在本文提出的方案中，为了提高系统对硬件中断的反应速度，避开uClinux对中断的慢处理，在操作系统与硬件之间建立了一个特殊的硬件抽象层来管理中断，并将纸币特征采集功能与操作系统剥离，放入一个单独的处理单元
2013-05-24 08:50:02
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BroadbandWirelessAccess)是当前通信界研究的热点之一，而WiMax和WiFi是BWA中最热门的两个技术，所以本文选择了IEEE802.16-2004与IEEE802.11a，设计了基于其物理层标准的可重配置
2013-05-19 19:10:01
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本文提出了"逻辑单元层"的概念，用具有特定几何结构的逻辑单元层来统一处理多种类型的逻辑资源。针对相对位置约束在现代FPGA布局软件中的重要地位，我们提出了一种处理相对位置约束的方法。
2013-06-21 04:40:01
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在第一层共享总线架构结构上采用总线监听一致性协议，第二层互联网络架构的结构上采用基于目录的一致性协议。
2016-11-28 20:21:07
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white-space: normal; background-color: rgb(255, 255, 255);">CRT显示器的工作原理是通电后灯丝发热，阴极被激发后发射出电子流，电子流受到高电压的金属层的加速
2022-04-09 00:00:01
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本文给出了IEEE802.15.4/ZigBee标准的介绍，给出了协议栈框架结构，从物理层到应用层进行了分析，并将ZigBee技术与其他无线通信技术做了比较，分析了ZigBee技术应用的场合。
2023-06-21 12:40:05
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该系统采用面向对象设计的思想，通过在用户界面层，业务逻辑层和数据访问层分别应用相关的设计模式，提高了系统的复用性、可扩展性和易于维护性。
2023-09-08 15:10:01
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小区搜索是WCDMA的重要物理层过程，是实现下行移动台和基站间同步的重要手段。
2023-09-28 10:10:01
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BroadbandWirelessAccess)是当前通信界研究的热点之一，而WiMax和WiFi是BWA中最热门的两个技术，所以本文选择了IEEE802.16-2004与IEEE802.11a，设计了基于其物理层标准的可重配置
2023-10-02 09:40:02
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在本文提出的方案中，为了提高系统对硬件中断的反应速度，避开uClinux对中断的慢处理，在操作系统与硬件之间建立了一个特殊的硬件抽象层来管理中断，并将纸币特征采集功能与操作系统剥离，放入一个单独的处理单元
2023-12-16 16:40:02
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BroadbandWirelessAccess)是当前通信界研究的热点之一，而WiMax和WiFi是BWA中最热门的两个技术，所以本文选择了IEEE802.16-2004与IEEE802.11a，设计了基于其物理层标准的可重配置
2024-04-14 04:40:01
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本文提出了"逻辑单元层"的概念，用具有特定几何结构的逻辑单元层来统一处理多种类型的逻辑资源。针对相对位置约束在现代FPGA布局软件中的重要地位，我们提出了一种处理相对位置约束的方法。
2024-05-10 06:10:01
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设计了发送端平方根升余弦滚降滤波器.然后介绍了自适应盲均衡器的设计,该均衡器是一个复数结构的横向滤波器,采用复用抽头的结构来节省资源,本文对自适应均衡器的核心运算单元-采用booth编码算法设计的高性能乘累加(MAC
2013-04-24 16:38:32
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另外，许多应用还可能使用其他非易失性器件(如 SPI Flash、Parallel Flash 或 PIC)来保存 MAC 地址等少量用户数据，因此导致系统电路板上存在大量非易失性器件。
2013-10-13 19:36:01
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概要
2 个对称的600MHz 高性能Blackfin 内核
328K Bytes 片内存储器
每个 Blackfin 内核包括:
2 个16 位MAC，2 个40 位ALU，4
2013-11-06 22:04:01
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另外，许多应用还可能使用其他非易失性器件(如 SPI Flash、Parallel Flash 或 PIC)来保存 MAC 地址等少量用户数据，因此导致系统电路板上存在大量非易失性器件。
2013-10-15 11:44:01
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工作组或者按照IP地址段自动搜索所有共享/FTP的mp3、电影或自定义搜索的文件；
3.内置nbtstat，能快速查找某一IP网段内的所有主机，并根据IP地址得到对方主机的主机名、工作组名、用户名、MAC
2015-04-29 10:09:02
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Bluetooth 低能耗控制器和 IEEE 802.15.4 MAC 嵌入在 ROM 中，并在 ARM Cortex-M0 处理器上单独运
行。此架构可改善整体系统性能和功耗，并释放闪存以供应用。
2023-01-01 16:40:02
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采用了自顶向下的设计方法，利用了Verilog HDL语言的结构描述风格，把整个设计分成6个模块，时钟分频模块，寄存器组模块，数据接收模块，数据发送模块，输出缓冲模块，时序控制模块，项层模块也采用语言描述
2013-04-24 16:38:36
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通过对变压器的并联和串联两种功率合成形式进行分析与比较，指出了匝数比、功率单元数目以及寄生电阻对变压器功率合成性能的影响；提出了一种片上变压器的设计方法，即采用多层金属叠层并联以及将功放单元内置于变压器线圈中的方式
2014-12-24 13:21:02
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