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网络环境是100M局域网,服务器端是INTEL双核本本+2003SP2,客户端是AMD双核台机+XPSP2,使用对联线联机.
2016-11-12 10:35:02
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// pica客户端J2ME源码，100％可运行可修改，J2ME逆向工程经典作品
// 作者：fangji999
// QQ：57979471 Email:fangji999@163.com
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2013-12-26 05:37:06
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-103F-3950-120L规格书26#线
MF52系列NTC热敏电阻规范：
·MF52D103F3435，MF52D-104F-3950，MF52E/10K-J，MF52E100K-J
2022-08-17 00:00:02
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目前与NOTEBOOK和LCD配套的中高档ADAPTER工作频率在60KHz~100KHz左右。变压器的绕组已用上了三重绝缘线，再要做小变压器已经有难度。
2023-05-15 13:40:02
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·《气体传感器论文资料》[PDF&NH&KDH]收集气体传感器的资料：★氨气传感器 NH3 CR-200 ★氨气传感器 NH3 MR-100 ★半导体臭氧气体传感器 ★半导体气敏元件 ★
2013-06-24 11:30:01
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这一版本增加的新内容主要有：用双绞线进行宽带接入的xDSL技术、千兆位以太网和100Mb／s以太网、可用比特率ABR服务和机制、TCP的拥塞控制、IP组播技术、Internet中的综合服务、区分服务，以及服务质量
2013-07-02 23:50:01
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平均每日便有100次下载，免费且正版，深受工程师喜爱的强大软件。
2013-05-28 12:10:01
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cpld用epm7128stc100-15，晶振20兆，tck频率5兆。用sjf2410作测试，以前写50k的文件用时5分钟，现在则是50秒左右。
2013-09-04 07:00:01
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设计了一种用于高速ADC中的全差分套筒式运算放大器.从ADC的应用指标出发,确定了设计目标,利用开关电容共模反馈、增益增强等技术实现了一个可用于12 bit精度、100 MHz采样频率的高速流水线(Pipelined
2013-10-16 21:48:01
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设计了一种高电源抑制比和低温度系数的带隙基准电压源电路，并在TSMC0.18Um CMOS工艺下，采用HSPICE进行了仿真.仿真结果表明：在-25耀115益温度范围内电路的温漂系数为9.69伊10-6/益，电源抑制比达到-100dB
2013-11-19 18:44:02
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R6的取值,R6的值不是任意取的,要考虑两个因素:1)431参考输入端的电流,一般此电流为2uA左右,为了避免此端电流影响分压比和避免噪音的影响,一般取流过电阻R6的电流为参考段电流的100
2013-10-26 01:08:02
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该软件可以精确的仿真、分析、优化从直流到高于100GHz频率的微波的电路。
Star-Hspice是理想的电路单元设计和模型处理的工具，也是信号完整性和传输线分析的选择工具。
2013-11-22 07:12:02
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该系统可通过键盘设置滤波器的种类、截止频率和Q值，低通、高通滤波器截止频率以及带通、带阻滤波器中心频率可预置范围为100 Hz~50 kHz，Q值范围为0.5~5。
2013-11-29 01:28:02
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其操作频率高达100MHz，采用3级流水线和哈佛结构，带独立的本地指令和数据总线以及用于外设的低性能的第三条总线，使得代码执行速度高达1.25MIPS/MHz，并包含1个支持随机跳转的内部预取指单元。
2013-10-27 10:12:01
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其操作频率高达100MHz，采用3级流水线和哈佛结构，带独立的本地指令和数据总线以及用于外设的低性能的第三条总线，使得代码执行速度高达1.25MIPS/MHz，并包含1个支持随机跳转的内部预取指单元。
2013-11-17 06:40:01
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be on the bus without
the need for bus buffers, higher total package sink capacity (400 mA versus 100
2013-10-12 09:16:01
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RS-485 是一种工业通信接口，其特点是在短距离传输时速度可以到35Mbps,长距离时速度可以到达 100 kbps. .由于外界环境或者大的感性负 载等原因，瞬态脉冲和浪涌也会在其数据线上产生尤是长距离传输中还很容易遇到线错接或者短路等突发问题
2013-12-30 15:49:07
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板载1路CAN总线控制器、1路10/100M自适应以太网适配器、2路RS-485接口、4路RS-232接口，支持VGA显示器接口。
2013-11-16 23:44:01
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1/100S计时器常用于比赛中及各种要求较精确的各领域，如果是中小规模集成电路也可以实现这个功能的，但是这个系统的体积较大可操作性差，所以这次使用VHDL语言和硬件相结合制作一个计时器。
2013-11-21 23:04:01
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cpld用epm7128stc100-15，晶振20兆，tck频率5兆。用sjf2410作测试，以前写50k的文件用时5分钟，现在则是50秒左右。
2015-05-16 00:53:01
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