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3阶FIR

3阶FIR,输入位宽12BIT ALTERA MAXPLUS II 及更高版本可打开
2017-05-18 00:17:01 下载 84 查看 1,069
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uCOSII平台下的LwIP移植笔记-焦海波

基于uC/OS-II的LWIP轻量级TCP/IP协议栈移植教程,非常详细。
2022-11-13 15:30:02 下载 1 查看 3,485
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Ucos学习资料大全

Ucos学习资料大全,包含Ucos中文书-邵贝贝、uCOS-II原理等资料
2022-11-18 01:40:02 下载 2 查看 7,010
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ALTERA NIOS处理器实验

ALTERA NIOS处理器实验,QUARTUS下用VHDL编译成处理器,然后NIOS SHELL下C 语言运行。实验SRAM和DMA调度
2015-04-13 20:21:02 下载 104 查看 1,040
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节约资源型 8位*8位 运算VHDL代码

QUARTUS下已验证
2015-08-10 00:04:01 下载 33 查看 1,096
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多功能数字钟

多功能数字钟,、在quartus 2环境中编译通过; 4、仿真通过并得到正确的波形; 5、给出相应的设计报告
2017-01-25 00:50:01 下载 40 查看 1,055
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基于EDA的测频测相程序

Quartus7.2中实现对移位信号的频率测量,也可通过对于高低电平脉宽的测量测量移位信号的相位
2025-06-10 02:40:01 下载 2 查看 8,932
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C编程思想

而是侧重对C语言中一些司空见惯的内容重新进行了剖析,如对C语言的思考、程序是什么的思考、教学顺序的思考、对变量是什么的思考、对模块化程序设计的思考、对递归函数的思考、对指针的思考等。
2016-01-11 23:51:36 下载 1 查看 37
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89S51单片机简介

很多初学51单片机的网友会有这样的问题:AT89S51是什么?书上和网络教程上可都是8051,89C51等!没听说过有89S51?
2013-10-09 13:08:01 下载 72 查看 1,043
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本文为VC++界面设计的一些小技巧

本文为VC++界面设计的一些小技巧,包括在MFC加入“这是什么?”的帮助提示,工具条使用,如何改变视窗颜色,为MFC应用程序添加全屏显示功能等,希望能对大家有帮助。
2015-10-01 10:09:02 下载 111 查看 1,088
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(凌阳的IDE平台) 用于16位单片机的无符号整数超过65535的数码显示

最后结果无论是什么请回复,因为我真的很想成为编程高手,谢谢!
2016-12-18 00:21:02 下载 66 查看 1,091
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JAVA计算器源代码

JAVA计算器源代码,现在大家明白了,不管你是什么样的网站,如果你使用了百度的站内搜索,那可就小心了,因为你的竞争对手可是随时虎视眈眈着你呢
2013-12-06 21:03:20 下载 79 查看 1,100
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基于ARM7的UCOS2基础实验

基于ARM7的UCOS2基础实验,uCOS-II for LPC2131 工程模板
2015-05-16 10:58:01 下载 165 查看 1,073
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Note that only the PORT is provided and it is assumed that you have the rest of the source for &micr

that only the PORT is provided and it is assumed that you have the rest of the source for µ C/OS-II
2013-11-25 15:06:08 下载 109 查看 1,088
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smartarm2200

smartarm2200,ucos-ii,EasyJTAG-H,tft4267 lcd,显示输入对话框。
2016-07-08 20:45:02 下载 170 查看 1,071
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基于周立功的lpc2131的试验

基于周立功的lpc2131的试验,,ucos-ii的中间件试验源码
2016-08-21 20:28:02 下载 57 查看 1,058
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采用Altera公司的FPGA芯片

采用Altera公司的FPGA芯片,在MAX+plus II软件平台上实现多路HDLC电路
2016-11-13 00:00:02 下载 27 查看 1,071
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PCF8583时钟芯片

PCF8583时钟芯片,II2读写程序,调试通过, 控制端口已说明。
2013-12-18 01:00:13 下载 141 查看 1,021
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semaphore.rar

UCOS II的信号量访问实例.嵌入式操作系统的入口学习资料
2023-11-25 15:20:01 下载 5 查看 3,528
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基于DSP Builder数字信号处理器的FPGA设计

并按照Matlab/Simulink/DSP Builder/QuartusⅡ设计流程,设计了一个12阶FIR 低通数字滤波器,通过Quartus 时序仿真及嵌入式逻辑分析仪SignalTapⅡ硬件测试对设计进行了验证
2013-11-17 00:44:01 下载 151 查看 1,097
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