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本课题以Xilinx公司的Spartan3E开发板为硬件开发平台，以ISE9.2i为软件开发平台，采用Verilog HDL编程实现该系统。
2013-07-22 14:40:01
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硬件电路设计采用硬件描述语言Verilog HDL进行描述。为了使系统具有良好的实时性，所有的模块都是以一个4×4块为处理单位，同时并行处理16个数据。
2023-06-27 06:40:03
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本课题以Xilinx公司的Spartan3E开发板为硬件开发平台，以ISE9.2i为软件开发平台，采用Verilog HDL编程实现该系统。
2023-09-26 07:30:02
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CRC 算法实现原理.
40. 用verilog写的FIR滤波器,不错可以.
2015-04-24 09:50:56
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设计中以Xilinx公司的Virtex-5系列的XC5VLX110-FF676为硬件平台，采用Verilog HDL硬件描述语言实现，利用Xilinx公司的ISE10.1工具布局布线，一共使用44438
2013-04-24 16:38:38
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设计中以Xilinx公司的Virtex-5系列的XC5VLX110-FF676为硬件平台，采用Verilog HDL硬件描述语言实现，利用Xilinx公司的ISE10.1工具布局布线，一共使用44438
2023-06-09 02:20:35
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完成了各模块HDL代码编写、仿真和调试。对设计FR滤波器所使用的分布式算法进行了改进。使用并串结构以及OBC编码以提高速度，减少FPGA资源消耗。
2023-09-15 18:10:01
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系统主要功能是用Verilog HDL设计硬件电路完成。
2023-09-30 02:30:01
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ModbusRTU协议采用的CRC校验生成及校验验证函数C语言实现.
12. uMemory 内存管理模块.
13. 微内核软实时操作系统.
14.
2015-04-24 09:50:57
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32. crc8的源代码.
33. 详细的嵌入式bootloader解释.
34. 51单片机控制 1602液晶显示 读取PS2键盘程序 按键会在1602上显示所按键.
2015-04-24 09:51:00
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SOPC CRC32 SOPC
SOPC 自定义外设.
3. 一个电话本的程序.
4. 嵌入式minigui 中自定义控件的应用实例。不下后悔！.
2015-04-24 09:51:01
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background-color: rgb(255, 255, 255);"/>1、 原理图分册：主要阐述Allegro SPB15.2的Design HDL
2022-08-14 01:10:02
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10. viterbi decoder , use verilog HDL language..
11. 三星ARM试验箱.
12. USB JTAG 卡.
2015-04-24 09:50:56
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I2C to GPIO Port expander的Verilog HDL
程序原码.
3. 做ARM仿真器和调试器的厂商需要RDI协议.
4.
2015-04-24 09:50:59
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DM9000A实现以太网媒体介质访问层(MAC)和物理层(PHY)的功能，包括MAC数据帧的组装／拆分与收发、地址识别、CRC
2022-09-08 18:20:02
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; line-height: 25px; text-align: left; background-color: rgb(247, 253, 255); ">消耗电流小，Icc=0.8mA；lm393是什么
2013-11-14 05:28:01
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(1) 集成的PLD/FPGA开发环境 由半导体公司提供，基本上可以完成从设计输入（原理图或HDL）→仿真→综合→布线→下载到器件等囊括所有PLD开发流程的所有工作。
2013-11-19 22:36:01
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(1) 集成的PLD/FPGA开发环境 由半导体公司提供，基本上可以完成从设计输入（原理图或HDL）→仿真→综合→布线→下载到器件等囊括所有PLD开发流程的所有工作。
2013-10-11 23:32:01
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important;"/>■ TWI通讯接口：支持CRC8校验
2021-11-22 14:30:01
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一、 历史回顾
总谐波失真（Total harmonic distortion） ，简称THD，并不是什么新的概念，早在几十年前的载波通信技术中就已有严格要求<
2014-12-24 04:24:14
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