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用verilog实现的串口收发数据程序，已经调试通过
2023-09-04 14:50:01
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verilog语言
2023-09-08 18:40:01
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altera fpga verilog 设计的基于查找表的DCT程序
2023-09-09 13:20:02
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I2C总线Verilog源代码描述，ModelSim仿真
2023-09-11 22:20:01
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FPGA内，通过Verilog语言实现冒泡法数据排序
2023-09-12 01:50:01
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节选自《Verilog 设计与验证》作者：吴继华、王诚
状态机是逻辑设计的重要内容，状态机的设计水平直接反应工程师的逻辑功底，所以许
多公司的硬件和逻辑工程师面试中，状态机设计几乎是必选题目。
2023-11-07 19:40:02
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基于Verilog语言的实用FPGA设计(美),国外verilog标准权威教材，现贡献出来，不下别后悔~~
2023-12-29 23:10:01
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本文举例说明了如何用软件实现脉宽调制(PWM)，如何将该设计转换成一个可以在FPGA
中运行的逻辑块，并能利用存储器
2024-09-12 16:30:01
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Lattice的EEPROM的I2C的VerilogHDL程序，已测，可以直接下到板子上使用
2024-10-14 17:00:02
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一些常见的功能模块的编程实现，rtl和行为级实现，有加法器、计数器、移位寄存器、状态机等等
2025-02-10 22:10:02
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讲解VerilogHDL硬件描述语言中阻塞赋值与非阻塞赋值问题。
2025-03-11 21:00:02
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基于FPGA的数字滤波器，verilog编程，给大家分享一下！
2025-11-20 05:46:01
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USB接口的VHDL源码，支持Verilog HDL程序
2014-08-14 13:30:32
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CAN总线IPCORE，采用Verilog HDL语言实现。
2013-12-25 00:03:08
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十六位的除法器，采用verilog hdl
2013-11-27 22:29:02
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华为fpga设计规范(Verilog_Hdl).docx
2023-11-10 06:00:01
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EDA的智力抢答器 关于verilog hdl
2024-06-15 07:10:01
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Implementation of Fast Fourier
Transform (FFT) on FPGA using
Verilog HDL
2025-05-25 14:50:02
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基于Verilog-HDL的硬件电路的实现
9.6 脉冲高电平和低电平持续时间的测量与显示
9.6.1 脉冲高电平和低电平持续时间测量的工作原理
9.6.2 高低电平持续时间测量模块的设计与实现
2013-11-30 01:48:02
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在设计过程中借助硬件描述语言verilog hdl的强大行为级描述能力直接进行系统级描述。
2013-12-25 12:34:11
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