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本原码是基于Verilog HDL语言的FPGA原程序，主要用于测频率，特点主要是可以更快地测频。实时性更高。
2015-08-04 20:27:01
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verilog HDL原码
一种简单的同步FIFO原码，可以被综合
2013-12-28 22:45:01
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拿verilog编写的som(自适应神经网络算法)，用于障碍物检测，基于FPGA可综合实验，已经在altera的cylcone上实现
2014-01-27 08:43:13
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拿verilog和vhdl编写的串口通信代码(可综合)
2015-08-22 10:27:01
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在quartusII下用verilog语言自己写的IP核，对FPGA开发初学者有帮助的。
2014-01-02 14:34:01
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verilog编程ps2接口设计,基于fpga的设计
2013-12-23 01:10:23
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iic implementation,用verilog实现了IIC标准协议的功能
2015-10-19 10:05:01
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verilog 编写的pic16c5x时钟模块
2015-10-25 00:29:01
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这是一个用verilog实现的除法器代码。
2013-12-28 08:53:07
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verilog 实现帧同步,比较简短的一个程序
2015-10-28 20:09:01
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【原创】生成各个子模块verilog文件的顶层文件，自动完成模块的互连。减少冗余的繁琐的劳动。提高工作效率。
2013-12-24 19:49:08
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uart串行口,用Verilog编写的.供大家参考
2013-12-15 12:47:01
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在利用Verilog在FPGA平台上输出正弦波，实现芯片为Cyclone II 484C8，有管脚分配
2015-11-29 00:27:01
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c54x的VeriLog程序代码
也是opencoreip
2015-11-30 10:08:01
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这里有verilog编写的8051ipcore 谁要啊?
2013-11-29 16:57:07
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用verilog语言编的正弦波发生器，可以用QuartusII来打开这个源码，也可以转换成VHDL语言
2014-11-27 09:47:02
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用Verilog做的VGA 480X640彩色驱动
2016-01-14 20:42:02
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將Verilog設計轉成VHDL設計的程式
2016-01-18 10:59:02
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SPI串口的内核实现
分verilog和HDLC实现
2014-01-16 11:28:13
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iic 总线 verilog 源代码
标准i2c总线， 有sda scl 时钟，频率自定
2014-10-26 04:00:49
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