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本程序用于检测音频文件中是否具有DTMF信号

确定了8个频点的能量后运用一系列判决门限来确定有没有DTMF信号,以及信号是什么
2017-03-15 10:26:02 下载 170 查看 1,091
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4×4矩阵键盘识别处理,键盘处理程序的任务是:确定有无键按下

4×4矩阵键盘识别处理,键盘处理程序的任务是:确定有无键按下,判断哪一个键按下,键的功能是什么;还要消除按键在闭合或断开时的抖动。
2017-05-21 00:13:02 下载 99 查看 1,073
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数字语音是信号的一种

数字语音是信号的一种,我们处理数字语音信号,也就是对一种信号的处理,那信号是什么呢? 信号是传递信息的函数。离散时间信号——序列——可以用图形来表示。
2017-08-15 00:15:02 下载 190 查看 1,086
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数字电钢琴(单片机)

不同的音调产生原理又是什么?而若是改变它们的音调,不知道会不会很麻烦,其电路要重新制作吗?系统会怎么修改?
2024-12-21 12:20:03 下载 7 查看 1,743
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《工作赢在心态》读后感

一个幼儿教师,一个合格的幼儿教师,首先要具备的是什么?可能有人会说:是扎实的基本功,是爱。这些我都赞同,但我觉得最应该具备的是强烈的责任心,责任感,没有强烈的责任感,责任心,一切都无从谈起。
2025-05-16 03:10:01 下载 2 查看 4,893
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amo的编程小工具集合V1_2_6.rar

功能: 1-8位校验和 2-16位校验和 3-计算CRC8 4-计算CRC16 5-计算CRC32 6-计算MD5 7-计算SHA1 8-十六进制字符串转换为Ascii字符串 9-Ascii
2023-06-29 01:30:03 下载 4 查看 4,540
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FPGA设计全流程

Synplify.Pro>>ISE\\r\\n第一章 Modelsim编译Xilinx库\\r\\n第二章 调用Xilinx CORE-Generator\\r\\n第三章 使用Synplify.Pro综合HDL
2013-08-20 20:30:01 下载 62 查看 1,106
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设计输入 ! 多种设计输入方法 – Quartus II • 原理图式图形设计输入 • 文本编辑 – AHDL, VHDL, Verilog • 内存编辑

原理图式图形设计输入 • 文本编辑 – AHDL, VHDL, Verilog • 内存编辑 – Hex, Mif – 第三方工具 • EDIF • HDL
2014-01-04 19:03:07 下载 171 查看 1,095
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介绍了一种采用硬件控制的自动数据采集系统的设计方法

介绍了一种采用硬件控制的自动数据采集系统的设计方法,包括数字系统自顶向下的设计思路、Verilog HDL对系统硬件的描述和状态机的设计以及MAX+PLUSII开发软件的仿真。
2016-07-01 00:34:01 下载 189 查看 1,087
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(网盘)FPGA 资料视频

黑金—Verilog HDL教程    -

黑金—NIOSII视频教程    -

黑金—FPGA

2022-06-14 19:00:02 下载 7 查看 6,783
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FPGA那些事儿--TimeQuest静态时序分析REV7.0

写《工具篇

I》不像写《Verilog HDL 那些事儿》系列的笔记一样,只要针对原理和HDL 内容作出

解释即可,虽然《Verilog HDL 那些事儿》夹杂着许多笔者对Verilog

2022-05-02 22:00:01 下载 11 查看 4,701
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数据链系统中的信道编译码仿真与FPGA实现.rar

随后,根据纠错编码的基本理论,结合战术数据链系统的具体特点,在对数据链的主要纠错编码技术(CRC、RS码、交织)理论分析基础上,给出了一种编译码方案设计并通过建模仿真上对其性能进行了分析;在此基础上,用硬件描述语言对系统进行了逻辑仿真实现
2023-09-27 05:20:01 下载 10 查看 3,065
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Topweaver 1.10

但是一些时候人们依然通过编写HDL代码来实现时钟的分频,以实现特殊的分频系数,可调节的占空比和其它DLL/PLL不容易实现的功能。
2013-07-19 16:20:01 下载 145 查看 1,147
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设计带进位算术逻辑运算单元

设计带进位算术逻辑运算单元,根据74LS181功能表,用Verilog HDL硬件描述语言编程实现ALU181的算术逻辑运算功能,编辑实验原理图,在算术逻辑单元原理图上,将其扩展为带进位的算术逻辑运算单元
2013-12-17 05:54:04 下载 196 查看 1,088
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逻辑设计说明文档模板

附件为Verilog HDL 工程/模块 详细设计报告文档模板,注意文档仅为框架,没有具体事例。

2022-01-07 02:00:02 下载 10 查看 6,978
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Topweaver

但是一些时候人们依然通过编写HDL代码来实现时钟的分频,以实现特殊的分频系数,可调节的占空比和其它DLL/PLL不容易实现的功能。
2024-04-26 18:00:01 下载 9 查看 4,430
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Topweaver 1.10

但是一些时候人们依然通过编写HDL代码来实现时钟的分频,以实现特殊的分频系数,可调节的占空比和其它DLL/PLL不容易实现的功能。
2024-05-07 04:30:01 下载 7 查看 5,351
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SOPC中FPGAIP核配置方案

接着采用自顶向下的IC设计方法,通过Verilog HDL语言编程设计了I2C的主...
2024-05-19 20:20:01 下载 8 查看 8,301
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TOPWEAVER 1.10

但是一些时候人们依然通过编写HDL代码来实现时钟的分频,以实现特殊的分频系数,可调节的占空比和其它DLL/PLL不容易实现的功能。
2014-03-30 12:22:13 下载 95 查看 9,682
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sscom5.10a

sscom5.12.1.rar ●升级内容: 增加放在屏幕最前端的功能,增加支持STC15,GD32系列MCU的ISP烧写,增加CRC校验时可选从数据串的第几个字节开始计算校验, 等等,改正数个bug.
2022-11-17 15:20:01 下载 3 查看 5,178
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