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FPGA那些事儿--TimeQuest静态时序分析REV7.0

两年前,编辑《时序篇》之际,笔者忽然对TimeQuest 产生兴趣,可是笔者当时却就连

时序是什么也不懂,更不明白时序有理想和物理之分,为此笔者先着手理想时序的研究。

2022-05-02 22:00:01 下载 11 查看 4,701
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基于STM32正弦波逆变器设计资料

从调试到现在已经烧毁了5片stm32都是cpu短路,等有空查查是什么原因。
2022-06-10 17:30:01 下载 7 查看 5,856
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STM32F103开发板 DHT11温湿度DS18B20 气体MQ-2光敏声控雨滴传感器实验程序

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GPIO_InitStructure.GPIO_Pin = GPIO_Pin_9;

GPIO_InitStructure.GPIO_Speed = GPIO_Speed_50MHz

2022-05-03 03:30:02 下载 8 查看 3,610
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微型机算计发展概述


参数:芯片采用PMOS工艺;集成度为2000管/片;时钟频率1MHz;平均指令执行时间为20μs。
2013-11-24 01:32:01 下载 53 查看 1,122
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基于FPGA的MPEG4协同处理器研究

是什么还在要求更高的压缩速率?还有被我们遗忘的地方吗?还有什么应用让我们继续追求更精妙的压缩算法? 在作者看来,这个应用领域就是移动视频服务。
2013-06-23 13:10:01 下载 95 查看 1,081
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MIPI中文入门

ContentsMIPI是什么

2022-05-08 11:00:01 下载 9 查看 511
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基于FPGA的MPEG4协同处理器研究

是什么还在要求更高的压缩速率?还有被我们遗忘的地方吗?还有什么应用让我们继续追求更精妙的压缩算法? 在作者看来,这个应用领域就是移动视频服务。
2023-11-02 04:30:01 下载 6 查看 5,415
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基于FPGA的MPEG4协同处理器研究

是什么还在要求更高的压缩速率?还有被我们遗忘的地方吗?还有什么应用让我们继续追求更精妙的压缩算法? 在作者看来,这个应用领域就是移动视频服务。
2024-02-16 05:20:01 下载 9 查看 2,209
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卫星电视初烧手册完全版(个人收藏)

6) 接收机的门限不同... 23 第十五章 【卫视知识】... 24 一、 数字卫星电视系统简介... 24 (1) DTH系统的组成... 24 二、 什么是地球同步卫星... 26 三、 IRD是什么
2024-09-17 11:50:02 下载 9 查看 7,805
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射频功率放大器及其线性化方法研究.rar

本文设计了一个工作频带为30-108MHz,增益为25dB的宽带射频功率放大器。由于工作频带较宽,输出功率较大,线性度要求高;所以在实际的过程中采用了宽带匹配,功率回退等技术来达到最终的设计目标。
2013-07-28 07:10:01 下载 176 查看 1,172
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应用VHDL基于FPGA设计FIR滤波器

仿真结果表明,本论文所设计的FIR滤波器硬件规模较小,采样率达到了17.73MHz。同时只要将查找表进行相应的改动,就能分别实现低通、高通、带通FIR滤波器,体现了设计的灵活性。
2013-04-24 16:38:25 下载 32 查看 1,146
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基于DSP/FPGA的多波形数字脉冲压缩系统硬件的研究与实现

该系统可处理时宽在42μs以内、带宽在5MHz以下的线性调频信号(LFM),非线性调频信号(NLFM)和Taylor四相码信号,且技术指标完全满足实用系统的设计要求。
2013-06-11 09:20:01 下载 169 查看 1,112
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基于FPGA的高速采样自适应滤波系统的研究

然后,利用最新DSP Builder工具建立了基于LMS算法的8阶2FSK信号去噪自适应滤波器的模型,结合多种EDA工具,在EPFlOKl00EQC208-1器件上设计出了最高数据处理速度为36.63MHz
2013-06-01 18:30:01 下载 142 查看 1,126
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基于ARMμCLinux的核地球物理数据采集系统的研究

该系统能够稳定运行在60MHz频率,无需上位机,用户就可与之进行交互工作,能够独立完成能谱数据的采集、分析、存储等功能。系统具有低功耗、小型化、高性价比等特点。
2013-04-24 16:38:29 下载 78 查看 1,152
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基于ARM和光纤传感技术的动态称重系统研究

课题采用的核心硬件为Xscale ARM平台,处理器时钟可高达400MHz;软件上采用了多用户、多任务的Linux操作系统平台。
2013-07-26 13:50:01 下载 86 查看 1,146
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(2,1,9)软判决Viterbi译码器的设计与FPGA实现

5.该设计在Altera EP1C20 FPGA芯片上通过测试,最大运行时钟频率110MHz,最大译码输出速率10.3Mbps。
2013-07-23 19:40:01 下载 163 查看 1,200
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卷积码在CDMA2000中的应用及其译码器FPGA实现

该译码器芯片具有可变的码率和帧长处理能力,可以运行于40MHZ系统时钟下,内部最高译码速度可达625kbps。
2013-06-24 08:30:02 下载 168 查看 1,100
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椭圆曲线密码体制中标量乘法运算的优化和FPGA实现

提出了合适的验证方案.该设计完成了椭圆曲线上的标量乘法运算.设计主要针对资源受限的应用环境:改进了有限域上的乘法运算、使用了没有预处理的标量乘算法.改进后的椭圆曲线标量乘法需要2,741,998个逻辑单元,在100MHz
2013-05-24 05:40:01 下载 65 查看 1,211
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基于FPGA的32位RISC处理器设计与实现

通过软件仿真和在Altera的FPGA开发板上进行验证,证明了所设计的32位RISC处理器能准确的执行所选用的MIPS指令集,运行速度能达到30MHz,功能良好。
2013-07-21 13:20:01 下载 40 查看 1,190
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基于FPGA的光接收机数据恢复电路

测试结果表明,采用该方案实现的时钟恢复电路可工作在光纤通信系统STM-4速率级,即622.08MHz频率上,各方面指标基本符合要求。
2013-04-24 16:38:35 下载 24 查看 1,090
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