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数字阵列雷达

  • 基于分数时延的宽带数字阵列波束形成

    为实现宽带数字阵列各阵元传输时延的精确补偿,引入分数时延滤波器。通过对一种分数时延滤波器设计方法及宽带数字阵波束形成原理的分析,提出针对有载波宽带雷达信号的接收波束形成实现结构。

    标签: 分数 时延 宽带 数字阵列

    上传时间: 2013-10-21

    上传用户:青春给了作业95

  • 自适应旁瓣对消在数字阵列雷达中的工程实现

    文中简要介绍了自适应旁瓣对消的基本原理,旁瓣对消模块在某雷达的应用,推导出便于工程实现的理论公式。在实际工作中能满足雷达系统抗干扰性能指标的要求。

    标签: 自适应旁瓣 数字阵列雷达 工程实现

    上传时间: 2013-11-09

    上传用户:mhp0114

  • 阵列雷达信号处理工具箱 阵列雷达信号处理工具箱

    阵列雷达信号处理工具箱 阵列雷达信号处理工具箱

    标签: 阵列 工具箱 雷达信号处理

    上传时间: 2014-01-01

    上传用户:yph853211

  • 基于FPGA的雷达信号数字接收机的实现

    在雷达信号侦察中运用宽带数字接收技术是电子侦察的一个重要发展方向。数字信号处理由于其精度高、灵活性强、以及易于集成等特点而应用广泛。电子系统数字化的最大障碍是宽带高速A/D变换器的高速数据流与通用DSP处理能力的不匹配。而FPGA的广泛应用,为解决上述矛盾提供了一种有效的方法。 本文利用FPGA技术,设计了具备高速信号处理能力的宽带数字接收机平台,并提出了数字接收机实现的可行性方法,以及对这些方法的验证。具体来说就是如何利用单片的FPGA实现对雷达信号并行地实时检测和参数估计。所做工作主要分为两大部分: 1、适合于FPGA硬件实现的算法的确定及仿真:对A/D采样信号采用自相关累加算法进行信号检测,利用信号的相关性和噪声的独立性提高信噪比,通过给出检测门限来估计信号的起止点。对于常规信号的频率估计,采用Rife算法。通过Matlab仿真,表明上述算法在运算量和精度方面均有良好性能,适合用作FPGA硬件实现。 2、算法的FPGA硬件实现:针对原算法中极大消耗运算量的相关运算,考虑到FPGA并行处理的特点,将原算法修改为并行相关算法,并加入流水线,这样处理极大地提高了系统的数据吞吐率。采用Xilinx公司的Virtex-4系列中的XC4VSX55芯片作为开发平台完成设计,系统测试结果表明,本设计能正常工作,满足系统设计要求。 文章的最后,结合系统设计给出几种VHDL优化方法,主要围绕系统的速度、结构和面积等问题展开讨论。

    标签: FPGA 雷达信号 数字接收机

    上传时间: 2013-06-24

    上传用户:songnanhua

  • 基于FPGA的雷达信号侦察数字接收机

    随着信号处理技术的进步和电子技术的发展,雷达信号侦察接收机逐渐从模拟体制向数字体制转变。软件无线电概念的提出,促使雷达侦察接收机朝大带宽、全截获方向发展,现有的串行信号处理体制已经很难满足系统要求。FPGA器件的出现,为实现宽带雷达信号侦察数字接收机提供了硬件支持。 本文结合FPGA芯片特点,在前人研究基础上,从算法和硬件实现两方面,对雷达信号侦察数字接收机若干关键技术进行了研究和创新,主要研究内容包括以下几个方面。 1)给出了基于QuartusII/Matlab和ISE/ModelSim/Matlab的两种FPGA设计联合仿真技术。这种联合仿真技术,大大提高了基于FPGA的雷达信号侦察数字接收机的设计效率。 2)给出了一种基于FFT/IFFT的宽带数字正交变换算法,并将该算法在FPGA中进行了硬件实现,设计可对600MHz带宽内的输入信号进行实时正交变换。 3)提出了一种全并行结构FFT的FPGA实现方案,并将其在FPGA芯片中进行了硬件实现,设计能够在一个时钟周期内完成32点并行FFT运算,满足了数字信道化接收机对数据处理速度的要求。 4)提出了一种自相关信号检测FPGA实现方案,通过改变FIFO长度改变自相关运算点数,实现了弱信号检测。提出通过二次门限处理来消除检测脉冲中的毛刺和凹陷,降低了虚警概率,提高了检测结果的可靠性。 5)在单通道自相关信号检测算法基础上,提出采用三路并行检测,每路采用不同的相关点数和检测门限,再综合考虑三路检测结果,得到最终检测结果。给出了算法FPGA实现过程,并对设计进行了联合时序仿真,提高了检测性能。 6)给出了一种利用FFT变换后的两根最大谱线进行插值的快速高精度频率估计方法,并将该算法在FPGA硬件中进行了实现。通过利用FFT运算后的实/虚部最大值进行插值,降低了硬件资源消耗、缩短了运算延迟。 7)结合4)、5)、6)中的研究成果,完成了对雷达脉冲信号到达时间、终止时间、脉冲宽度和脉冲频率的估计,最终在一块FPGA芯片内实现了一个精简的雷达信号侦察数字接收机,并在微波暗室中进行了测试。

    标签: FPGA 雷达信号 数字接收机

    上传时间: 2013-06-12

    上传用户:Divine

  • 船用导航雷达数字信号处理设计

    当今的船用导航雷达具有数字化、多功能、高性能、多接口、网络化。同时要求具有高可靠性、高集成度、低成本,信号处理单元的小型化,产品更新周期短。要同时满足上述需求,高集成度的器件应用是必须的。同时开发周期要短,需求软件的可移植性要强,并且是模块化设计,现场可编程门阵列器件(FPGA)已经成为设计首选。 现场可编程门阵列是基于通过可编程互联连接的可配置逻辑块(CLB)矩阵的可编程半导体器件。与为特殊设计而定制的专用集成电路(ASIC)相对,FPGA可以针对所需的应用或功能要求进行编程。虽然具有一次性可编程(OTP)FPGA,但是主要是基于SRAM的,其可随着设计的演化进行重编程。CLB是FPGA内的基本逻辑单元。实际数量和特性会依器件的不同而不同,但是每个CLB都包含一个由4或6个输入、一些选型电路(多路复用器等)和触发器组成的可配置开关矩阵。开关矩阵是高度灵活的,可以进行配置以便处理组合逻辑、移位寄存器或RAM。当今的FPGA已经远远超出了先前版本的基本性能,并且整合了常用功能(如RAM、时钟管理和:DSP)的硬(ASIC型)块。由于具有可编程特性,所以FPGA是众多市场的理想之选。它高集成度,以及用于设计的强大软件平台、IP核、在线升级可满足需求。 本文介绍了基于FPGA实现船用导航雷达数字信号处理的设计,这是一个具体的、已经完成并进行小批量生产的产品,对指导实践具有一定意义。

    标签: 导航雷达 数字信号处理

    上传时间: 2013-04-24

    上传用户:稀世之宝039

  • 相控阵雷达导引头捷联去耦数字平台设计

    相控阵雷达导引头是未来导引头发展的一个重要领域,为了消除弹体扰动对导引头测量误差的影响,实现相控阵雷达导引头的捷联去耦,设计了一种相控阵雷达导引头捷联去耦数字平台,采用基于四元数法求取弹体的姿态角,采用相控阵雷达导引头波束扫描稳定算法实现对波束扫描误差的补偿,达到导引头捷联去耦的目的,并在MATLAB中对四元数法和波束扫描稳定算法进行了仿真验证,取得了较好的去耦效果,该相控阵雷达导引头捷联去耦数字平台具有原理简单、算法运算量小和去耦效率高的特点

    标签: 相控阵雷达 导引头 去耦 捷联

    上传时间: 2013-10-20

    上传用户:Tracey

  • 介绍了一套基于PCI 总线的软件无线电开发平台它适用于雷达无线电信号信息 测试和测量等领域该文探讨了开发软件无线电系统的一些实际问题并介绍了如何利用加拿大 ICS 公司的高速数字变换板来开发软件无

    介绍了一套基于PCI 总线的软件无线电开发平台它适用于雷达无线电信号信息 测试和测量等领域该文探讨了开发软件无线电系统的一些实际问题并介绍了如何利用加拿大 ICS 公司的高速数字变换板来开发软件无线电系统

    标签: PCI ICS 开发软件 总线

    上传时间: 2015-04-12

    上传用户:libinxny

  • 直接数字频率合成技术在通信领域的应用,尤其在雷达导航上发挥了极大作用.

    直接数字频率合成技术在通信领域的应用,尤其在雷达导航上发挥了极大作用.

    标签: 数字频率 合成技术 导航 通信领域

    上传时间: 2013-11-28

    上传用户:ecooo

  • 高频地波雷达中双排线形天线阵列的盖氏圆盘法估计信号源数

    高频地波雷达中双排线形天线阵列的盖氏圆盘法估计信号源数

    标签: 高频地波 雷达 天线阵列 信号源

    上传时间: 2015-10-06

    上传用户:003030